- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377598 > L64360 (LSI Corporation) Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) PDF資料下載
參數(shù)資料
| 型號(hào)： | L64360 |
| 廠商： | LSI Corporation |
| 英文描述： | Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) |
| 中文描述： | 高度集成的自動(dòng)柜員機(jī)分段和重組（SAR）的網(wǎng)絡(luò)應(yīng)用（用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎） |
| 文件頁數(shù)： | 55/232頁 |
| 文件大小： | 1389K |
| 代理商： | L64360 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁當(dāng)前第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁
Serial Interface Data Addressing
5-3
Port (if HBS_BOOT asserted) as 32-bit words. The ATMizer Architecture
stores these instructions temporarily into system memory.
After the entire code (less than or equal to 4 Kbytes) has been stored into
the system memory through the ATMizer Architecture, the external logic
must deassert SRL_BOOT HIGH to initiate the boot. Since it may be dif-
ficult to design logic that can deassert SRL_BOOT exactly one cycle after
thelastbitofcodehasbeenloaded,LSILogicrecommendsthatthesystem
designer create a RC Circuit to deassert SRL_BOOT as soon as possible
aftertheentirecodehasbeenloaded.Thisproceduremaycausesomeextra
data to be loaded into the Secondary Port or the Host/DMA Port, but this
should not present a problem as long as the user program does not try to
access this extra data.
5.3
Serial Interface
DataAddressing
The ATMizer Architecture loads up to 4 Kwords in one download cycle.
To provide flexibility for serial downloading, a portion of the first word
thattheSerialInterfacefetches(theSegmentAddress)isusedastheupper
address for the serial downloading write operation. For a Host/DMA Port
write operation, Segment Address Bits [31:14] are passed to The Host/
DMA Port as HBS_A[31:14]. For a Secondary Port write, since there are
only22bitsintheaddress,SegmentAddressBits[21:14]arepassedtothe
Secondary Port as SP_AD[21:14]. Bits [31:23] and [13:0] of the Segment
Address are ignored and should be cleared to zeroes. This format allows
thesystemdesignertodumpthecodesanywhereinthesystemmemoryon
a 16-Kbyte boundary. As each word arrives, the ATMizer Architecture
increments the Host/DMA or Secondary Port Address Bits [13:0] by four.
Tables
5.1
and
5.2
show examples of how the Segment Address is used for
the write address.
Table 5.1
Serial Interface
Data Addressing
through the
Secondary Port
Segment Address HBS_BOOT
Serial Download Write Address
(SP_AD[21:0])
Word 1
Word 2
. . .
Word 4095
0x00000000
LOW
0x000000
0x000004
. . .
0x003FFC
. . .
0x043FFC
. . .
0x3FFFFC
0x00040000
LOW
0x040000
0x040004
0x003FC000
LOW
0x3FC000
0x3FC004
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| L64364 | Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) |
| L64381 | 4-Port Ethernet Controller(四端口以太網(wǎng)控制器) |
| L64388 | A General-Purpose,High-Performance Remote Access Communications Processor(通用的、高性能、遠(yuǎn)程訪問通信處理器) |
| L64704 | Satellite Decoder Which Contains A BPSK/QPSK Demodulator And A Concatenated FEC Decoder(衛(wèi)星信號(hào)譯碼器（包含BPSK/QPSK 解調(diào)器和FEC解碼器）) |
| L64724 | Satellite Receiver(衛(wèi)星信號(hào)接收器（包含BPSK/QPSK 解調(diào)器和FEC解碼器）) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| L64360A1-50 | 制造商:LSI Corporation 功能描述:64360A1-50 |
| L64360A1-WV3E41FAA | 制造商:LSI 功能描述: 制造商:LSI Corporation 功能描述: |
| L64360A2-40 | 制造商:LSI 功能描述: 制造商:LSI Corporation 功能描述: |
| L64364 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:L64364 ATMizer II+ ATM-SAR Chip programming guide 1/00 |
| L64364NL | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Telecomm/Datacomm |
發(fā)布緊急采購，3分鐘左右您將得到回復(fù)。