- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377598 > L64360 (LSI Corporation) Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) PDF資料下載
參數(shù)資料
| 型號(hào)： | L64360 |
| 廠商： | LSI Corporation |
| 英文描述： | Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) |
| 中文描述： | 高度集成的自動(dòng)柜員機(jī)分段和重組（SAR）的網(wǎng)絡(luò)應(yīng)用（用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎） |
| 文件頁數(shù)： | 49/232頁 |
| 文件大?。?/td> | 1389K |
| 代理商： | L64360 |
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APU External Access
4-7
congestionnotificationisfound,theAPUcantakeimmediateaction.Such
actions may include one or more of the following:
1. Notify the Host that congestion has been seen utilizing the ATMizer
Architecture-to-Host messaging scheme developed by the user
2. Lower the segmentation rate for each VC
3. Reduce the overall assigned cell throughput rate by setting a lesser
value in the Global Pacing Rate Register
4. Set the CLP fields of outgoing cells to zero instead of lowering the
overall information rate
4.11
APU External
Access
The APU can directly access the external devices through either the Host/
DMA Port or the Secondary Port. For APU direct access loads and stores,
theaddressspaceonbothinterfacesis4 Mbytes.TheAPUhasafour-word
writebufferwhichenhancesthroughputduringback-to-backstoretransac-
tions.TheAPUalsosupportsloadscheduling,soaloadoperationdoesnot
stall the APU if the data is not required immediately.
Effective Address Bits [23:22] define whether the operation is a Host/
DMA Port direct access or a Secondary Port direct access (see Figures
4.3
through
4.6
).
This section explains APU direct access through the Host/DMA Port.
Direct access through the Secondary Port is explained in
Chapter 10
.
Figure 4.1
shows the Host/DMA Port MSB Substitution Register format.
Figure 4.1
MSB Substitution
Register
The MSB Substitution Register’s Effective Address (the address used by
the code) is 0xFFF04D00.
The MSB (Most Significant Bit) Substitution Register holds the 10 most
significant bits of the address for an APU direct access through the Host/
DMA Port. These 10 bits are valid only during an APU load or store
through the Host/DMA Bus.
15
10 9
0
Reserved
1
1. All reserved bits must be 0.
MSB Substitution Bits
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