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參數(shù)資料
| 型號： | L64360 |
| 廠商： | LSI Corporation |
| 英文描述： | Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) |
| 中文描述： | 高度集成的自動柜員機分段和重組（SAR）的網(wǎng)絡(luò)應用（用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎） |
| 文件頁數(shù)： | 25/232頁 |
| 文件大小： | 1389K |
| 代理商： | L64360 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁當前第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁
Applications
1-9
Scatter-Gather
DMA
TheAPUcanexecutesegmentationandreassemblyroutineswrittenbythe
system designer that perform scatter (segmentation) and gather (reassem-
bly) of noncontiguous data structures (data structures that logically form a
single CS-PDU) as is done in a Scatter-Gather DMA controller. The user
can supply routines that handle ATM Adaptation Layer (AAL) and ATM
header generation and extraction as well as link-list pointer management
and buffer allocation.
Application
Acceleration
Some applications can be accelerated by header stripping and data align-
ment. The ATMizer Architecture can aid network software by stripping
higher-layer headers from incoming CS-PDUs and placing them in spe-
cific memory locations. In addition, the ATMizer Architecture can utilize
the powerful byte-alignment capabilities of its DMA Controller to ensure
that the user-data payload portion of the higher-layer PDU is written into
memory word-aligned. This procedure releases application-layer software
from the responsibility of ensuring proper data alignment.
Cell Switching
The ATMizer Architecture allows you to terminate all Virtual Channels
(VCs) or terminate some VCs while switching others.
On a per-VC basis the APU can make a determination as to whether it
shouldreassembletheSegmentationandReassembly(SAR)User-Payload
into a CS-PDU or simply pass the entire cell, headers and trailers intact, to
some other memory-mapped ATM port or ATM switch interface. The
ATMizerArchitecturecanevenswitchcellsbetweenitsreceiverandtrans-
mitter without touching system memory. This implementation structure
can be put to use in ring, dual, and triple-port switching fabrics, and other
topologies.
TheAPUcanmakecell-switchingdecisions(whethertotranslatetheVCI,
the VPI, or both, or neither, or whether to do multicast expansion) in real-
time and then perform the operations. Furthermore, in switching applica-
tions, the ATMizer Architecture can support a user cell size of up to 65
bytes, which allows the user to include up to 12 bytes of switch-specific
information to each cell.
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