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參數(shù)資料
| 型號： | L64360 |
| 廠商： | LSI Corporation |
| 英文描述： | Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網絡的高度集成的異步傳輸模式-分段和重組處理芯片) |
| 中文描述： | 高度集成的自動柜員機分段和重組（SAR）的網絡應用（用于優(yōu)化網絡的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎） |
| 文件頁數(shù)： | 11/232頁 |
| 文件大小： | 1389K |
| 代理商： | L64360 |
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Contents
xi
Chapter 13
Functional Waveforms
13.1
Secondary Port
13.2
Host/DMA Port
13.3
Serial Interface
13.4
ACI Transmitter
13.5
ACI Receiver
13-1
13-5
13-12
13-15
13-17
Chapter 14
Registers
14.1
14.2
System Control Register
APU Core Registers
BIU/Cache Configuration Register
Status Register
Status Register Mode Bits and Exception Processing
Cause Register
Bad Address Register
Target Address Register
Exception Program Counter Register
Processor Revision Identifier Register
Debug and Cache Invalidate Control Register
Breakpoint Program Counter Register
Breakpoint Program Counter Mask Register
Breakpoint Data Address Register
Breakpoint Data Address Mask Register
Other Registers Summary
Host Interrupt Register
MSB Substitution Register
PRU Channel Group Credit Register
PRU 12-Bit Count Initialization Registers
PRU 24-Bit Count Initialization Registers
PRU Configuration Register
PRU Stall Register
DMAC Control Register
CRC32 Register
ACI Current Received Cell Address Register
Received Cell Indicator Register
ACI Global Pacing Rate Register
14-1
14-6
14-7
14-9
14-12
14-13
14-14
14-15
14-15
14-16
14-16
14-19
14-19
14-20
14-20
14-20
14-20
14-21
14-21
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14-22
14-22
14-23
14-23
14-23
14-24
14-24
14.3
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PDF描述 |
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