- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377598 > L64360 (LSI Corporation) Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) PDF資料下載
參數(shù)資料
| 型號： | L64360 |
| 廠商： | LSI Corporation |
| 英文描述： | Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) |
| 中文描述： | 高度集成的自動柜員機分段和重組（SAR）的網(wǎng)絡(luò)應(yīng)用（用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎） |
| 文件頁數(shù)： | 163/232頁 |
| 文件大小： | 1389K |
| 代理商： | L64360 |
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13-1
Chapter 13
Functional Waveforms
This chapter contains and describes the ATMizer Architecture functional
waveforms.
This chapter has five sections:
I
Section 13.1, “Secondary Port”
I
Section 13.2, “Host/DMA Port”
I
Section 13.3, “Serial Interface”
I
Section 13.4, “ACI Transmitter”
I
Section 13.5, “ACI Receiver”
Note
In some places within the waveforms, the letter A represents Address, the
letter B represents Byte, the letter D represents Data, and the letter W rep-
resents Word.
13.1
Secondary Port
Figure 13.1
shows the ATMizer Architecture performing a single-word
read and a single-word write through the Secondary Port. First the
ATMizerArchitectureassertsSP_RQtoinitiateatransaction.Theexternal
arbiter gives the bus grant to the ATMizer Architecture by asserting
SP_GNT. The ATMizer Architecture generates valid addresses on
SP_AD[31:0] after external logic asserts SP_GNT. External logic latches
the address and control information at the rising edge of CLK when
SP_GNT and SP_ASEL are both asserted HIGH. After external logic has
latched the address, it deasserts SP_ASEL to start the data phase of the
transaction.
For a read operation, the ATMizer Architecture detects SP_ACK LOW at
the rising edge of CLK and latches the data on rising edge of CLK one
clock cycle later.
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