- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377598 > L64360 (LSI Corporation) Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) PDF資料下載
參數(shù)資料
| 型號： | L64360 |
| 廠商： | LSI Corporation |
| 英文描述： | Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) |
| 中文描述： | 高度集成的自動柜員機(jī)分段和重組（SAR）的網(wǎng)絡(luò)應(yīng)用（用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎） |
| 文件頁數(shù)： | 68/232頁 |
| 文件大小： | 1389K |
| 代理商： | L64360 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁當(dāng)前第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁
6-8
Virtual Channel RAM (VCR)
6.4
Cell
Multiplexing
and
Demultiplexing
The ATMizer Architecture can simultaneously handle up to 65536 VCs,
performing cell multiplexing and pacing for all of the active channels.
However, there are trade-offs to be made between the number of channels
supported, the data rate of the ATM Port, and the cost and structure of the
memory.
For example, in a network interface card operating at desktop speeds less
than or equal to 45 Mbits/s, it is possible to limit the number of VCs sup-
ported to 64 (32 Transmission and 32 Receive). In this case:
I
The VCR can be used to cache all the relative parameters for each of
these channels
I
The ATMizer Architecture need only access main memory to retrieve
and retire SAR-SDUs and Host Memory can be used for CS-PDU
storage
I
The NIC itself need not contain any memory
In applications requiring the support of a very large number of channels,
theVCRcannotholdalloftheneededchannelinformation.Itmaybenec-
essary to provide high-speed SRAM, that can be accessed by the ATMizer
Architecture Secondary Port, for Channel Parameter Entry storage. The
SRAM gives the ATMizer Architecture fast access to the information
needed for segmenting and reassembling CS-PDUs and for the switching
of cells. CS-PDU storage could be handled in a local DRAM or SRAM-
based memory system that is accessible by the ATMizer Architecture
DMA Controller.
Systemscanbeacrossbetweenthetwoexamplesabove.Insomesystems,
it is possible to limit the number of simultaneously active transmission
channels.ThereisnolimitonthenumberoftransmissionVCIssupported,
only in the number that can have CS-PDUs under segmentation at any one
time. If the number is limited to 32, then all Transmission Channel Param-
eters can be cached internally. The time saved by caching Transmission
Parameters in the VCR can be used to retrieve the parameters needed for
reassembly. This time usage may allow the use of a single interleaved
DRAM system for both CS-PDU and Channel Parameter storage. An
unlimitednumber oftransmissionVCIscanbesupportedbyswappingout
aCPE/VC/CS-PDUforanewCPE/VC/CS-PDUonceitsCS-PDU(orCS-
PDU fragment) has been segmented.
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