- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377598 > L64360 (LSI Corporation) Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) PDF資料下載
參數(shù)資料
| 型號： | L64360 |
| 廠商： | LSI Corporation |
| 英文描述： | Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) |
| 中文描述： | 高度集成的自動柜員機分段和重組（SAR）的網(wǎng)絡(luò)應(yīng)用（用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎） |
| 文件頁數(shù)： | 148/232頁 |
| 文件大?。?/td> | 1389K |
| 代理商： | L64360 |
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12-16
Operation
buffer fills, the ATMizer Architecture can be instructed (through an exter-
nal event) to retrieve the SAR User Payload, retrieve RTS, or generate
Sequence Number/Sequence Number Protection (SN/SNP) values and
append the SAR Header and transfer the cell to the transmission conver-
gence framing logic using the ACI Transmitter. As the ATMizer Architec-
ture is generating a cell from one buffer, the other buffer is being refilled
by the realtime data source. Eventually the second buffer fills and the first
buffer becomes the active fill buffer. AAL 1 datastreams are continuous in
time. The APU under user firmware control creates the Sequence Number
and Sequence Number Protection fields internally but is passed the Resid-
ual Time Stamp Field from an external device. Residual Time Stamp val-
ues can be passed to the ATMizer Architecture in Byte 0 of the SAR-SDU
(the logical positioning, in this case external logic calculates the RTS and
writes it into the data buffer) or the APU can proactively retrieve the RTS
value, when needed, utilizing either the Secondary Port or the DMA Con-
troller. The APU implements RTS and SN/SNP interleaving on transmis-
sion and passes the SAR SDUs and RTS values to the appropriate buffers
or interfaces. The APU also performs SN/SNP checking on reassembly.
The actualAAL 1cellgenerationand received cellhandlingroutinesmust
be written by the user.
Figure 12.5
shows AAL 1 Circuit Emulation and Data Buffering.
Figure 12.5
AAL 1 Circuit
EmulationandData
Buffering
Insituations whereDS1s aretobesourcedoveranATMport,the DS1low
data rates allow for multiple lines to be easily handled. In low-speed
Memory
Null Convergence Sublayer
96-Byte Buffer
SAR
Sublayer
From A
SAR Payload
47 Bytes
Cell Payload
48 Bytes
From B
SAR Payload
47 Bytes
Cell Payload
48 Bytes
From A
SAR Payload
47 Bytes
Cell Payload
48 Bytes
A
B
Time
ATM
Header
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PDF描述 |
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