參數(shù)資料
型號(hào)： L64360
廠商： LSI Corporation
英文描述： Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片)
中文描述： 高度集成的自動(dòng)柜員機(jī)分段和重組（SAR）的網(wǎng)絡(luò)應(yīng)用（用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎）
文件頁數(shù)： 32/232頁
文件大小： 1389K
代理商： L64360
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3-2
Signal Descriptions
Figure 3.1
L64360 Logic
Symbol
3.2
Host/DMA Port
These signals interface the L64360 DMA Controller and APU to the Host
Bus. For more information on the DMAC see
Chapter 8
.
HBS_A[31:2]
Host/DMA Port Address Bus
DuringDMAorCPUoperations,theHost/DMAPortdrivesthis
addressbustoprovideL64360addressestosystemcomponents.
Each time HBS_ACK is asserted, the word address
HBS_A[23:2] is incremented. HBS_A[31:24] are never incre-
mented, so user firmware should never initiate burst operations
that cross 16-Mbyte boundaries. After a system reset, the
L64360 3-states HBS_A[31:2].
Output
HBS_ACK
Host/DMA Port Data Acknowledgment
Asserting HBS_ACK LOW indicates that there is valid data on
HBS_D[31:0]. During Host/DMA Port writes to an external
device, the device should assert HBS_ACK LOW to inform the
Input
HBS_GNT
HBS_RQ
HBS_END
SP_WR
SRL_ACK
SRL_BOOT
SRL_DIN
SRL_CLK16
HBS_BOOT
HBS_D[31:0]
RC_CLK
RC_D[7:0]
RC_FULL
HEC_ERR
RC_ACK
RC_BOC
RC_RST
HBS_INT
PRU_CLK
RST
STALL
TEST
CLK
HBS_DOE
HBS_ACK
HBS_AOE
HBS_AS
HBS_A[31:2]
HBS_S[2:0]
HBS_WR
HBS_BE[3:0]
SP_ACK
SP_AD[31:0]
SP_BWIDE
SP_GNT
SP_RQ
SP_ASEL
TX_CLK
TX_D[7:0]
TX_DRDY
TX_FULL
TX_IDLE
TX_RST
TX_ACK
TX_BOC
GPINT_AUTO
GPINT_TST
Host/DMA
Port
Interrupt/
Messaging
Miscellaneous
Operation
ACI
Transmitter
ACI
Receiver
Secondary
Port
Serial
Interface
L64360
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