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參數(shù)資料
| 型號： | L64360 |
| 廠商： | LSI Corporation |
| 英文描述： | Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡的高度集成的異步傳輸模式-分段和重組處理芯片) |
| 中文描述： | 高度集成的自動柜員機分段和重組（SAR）的網(wǎng)絡應用（用于優(yōu)化網(wǎng)絡的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎） |
| 文件頁數(shù)： | 102/232頁 |
| 文件大小： | 1389K |
| 代理商： | L64360 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁當前第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁
9-6
ATM Cell Interface (ACI)
erated and EA[31:0] = 0xFFF04540 if CRC10 is to be generated for the
cell to be transmitted.
If the APU attempts to write an address to the Cell Address FIFO, but the
Cell Address FIFO is already full, the write operation will cause the APU
to stall. The APU remains in the stall operation until the ACI Transmitter
finishessendingacellandalocationbecomesavailableintheCellAddress
FIFO. The status of the FIFO can be checked by reading the System
Control Register Bits [2:0], which indicates how many addresses are left
intheFIFO.TheAPUcanpreventwritinganaddressintoafullbuffer(and
prevent the delays associated with it) by testing the state of the buffer
before beginning a segmentation or cell switching application.
Another way to prevent the APU from stalling due to a full address FIFO
is to enable APU Interrupt4. Interrupt4 is very useful for firmware coding.
The Assigned Cell Address FIFO can store up to four addresses. When
there is only one address left in the Cell Address FIFO, the ACI asserts
Interrupt4. Then the interrupt routine can fill the FIFO all at once by writ-
ing three more transmission cell addresses. The write operation clears
Interrupt4.
Note
The CpCond and Interrupt signals are internal to the APU core which is
part of the ATMizer Architecture. Refer to the
CW33300 Enhanced Self-
Embedding Processor Core User’s Manual
for more information.
Cell Rate
Decoupling
The Cell Address FIFO mentioned above is a four-word FIFO that holds
the VCR addresses of cells that are ready for transmission. When the ACI
Transmitter reaches the end of a cell, it checks the Cell Address FIFO to
see if an address exists for a completed cell. If it does, the ACI Transmitter
automatically begins fetching the new cell from the VCR and sending it,
one byte at a time, to the external transmission convergence framing logic
over TX_D[7:0]. If an address does not exist in the Cell Address FIFO
when the end of the present cell is reached, the ACI Transmitter performs
Cell Rate Decoupling.
Aspartofitsstart-upcodeandpriortoinitiatingtransmitteroperations,the
APUmustbuildacompleteIdleCellinthelast64bytesoftheVCRspace.
The Idle Cell pattern should be the same length as the user defined Trans-
mit Cell Size. By designating an area in the VCR as the Idle Cell Holder,
a user is free to generate an Idle Cell that matches his switch specific
structure.
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