參數(shù)資料
型號： L64360
廠商： LSI Corporation
英文描述： Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片)
中文描述： 高度集成的自動柜員機分段和重組（SAR）的網(wǎng)絡(luò)應(yīng)用（用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎）
文件頁數(shù)： 21/232頁
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代理商： L64360
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Features
1-5
I
Implements a user-programmable 32-bit MIPS RISC CPU (ATMizer
Processing Unit) controls all aspects of the ATM cell generation and
switching processes
The APU controls:
–
Scatter-gather DMA Algorithms
–
AAL SAR-PDU Header and Trailer Generation
–
ATM Header Generation and Manipulation
–
Host Interrupt/Messaging
–
Error Handling
–
Congestion Control
–
Statistics Gathering
–
Diagnostic Operation
–
User-defined Functions
I
Internal caching of data structures, buffer link lists, and messages in
4-Kbyte Virtual Channel RAM (VCR), coupled with received cell
buffers, allows for the development of memory-less network interface
cards(allCS-PDUsundergoingsegmentationandreassemblyresidein
system memory)
I
General purpose 32-bit (address/data multiplexed) Secondary Port
Interface with 4-Mbyte address space
I
Four-word Prefetch Buffer
I
Four-word Write Buffer
I
Supportsatomic(read-modify-write)transactionsandHost/DMAPort
CPU steal cycle
I
DirectconnectiontotheUniversalTest&OperationsCell-basedPhys-
ical layer (PHY) Interface for ATM (UTOPIA) and Standard ATM
Interface (SAI)
I
Supports cell size transformation for use in application that converts
standard ATM cell into switch specific format
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PDF描述
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