參數(shù)資料
型號: L64360
廠商: LSI Corporation
英文描述: Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片)
中文描述: 高度集成的自動柜員機分段和重組(SAR)的網(wǎng)絡(luò)應用(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎)
文件頁數(shù): 171/232頁
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代理商: L64360
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Host/DMA Port
13-9
Figure 13.9
Block Fetch followed by a
Single-Word Store
Figure 13.10
shows a 16-byte DMA read with a CPU steal cycle. The
ATMizer Architecture starts the DMA operation and detects the assertion
of HBS_ACK. Internally, the APU (CPU) issues a write operation. Since
the APU has a higher priority than the DMAC, the ATMizer Architecture
suspends the DMA operation by asserting HBS_END after detecting the
second HBS_ACK assertion. The ATMizer Architecture reasserts
HBS_AS along with outputting a new CPU write address and data. After
the ATMizer Architecture detects the HBS_ACK assertion for the CPU-
steal cycle, it reasserts HBS_AS and resumes the stalled DMA operation.
CLK
HBS_AS
HBS_RQ
HBS_WR
HBS_A[31:0]
HBS_GNT
HBS_BE[3:0]
A
1
HBS_ACK
HBS_S[2:0]
A
2
A
3
A
4
Address
HBS_D[31:0]
0
0
D
2
D
3
D
4
Data
D
1
MD94.173
HBS_END
0
4
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PDF描述
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