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參數資料
| 型號： | L64360 |
| 廠商： | LSI Corporation |
| 英文描述： | Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網絡的高度集成的異步傳輸模式-分段和重組處理芯片) |
| 中文描述： | 高度集成的自動柜員機分段和重組（SAR）的網絡應用（用于優(yōu)化網絡的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎） |
| 文件頁數： | 142/232頁 |
| 文件大?。?/td> | 1389K |
| 代理商： | L64360 |
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12-10
Operation
/**********************************************************
Clear the error condition bits in the sys_ct_reg
set block size = 4 (for hp block fetches by CPU)
**********************************************************/
li r10, 0x00080070
sw r10, (sys_ct_reg)
/**********************************************************
Initialize APU BCC Reg: no wait state between bus
transactions, enable i$, d$, block size = 4
**********************************************************/
sw apu_d, (apu_bcc)
/* Clear PRU CpCond and Interrupt */
sw stall_val, (stall_reg)
sw r0, (conf_reg)
lw r10, (cr_reg)
lw r10, 0x80(cr_reg)
# Write 0xfffffff to stall reg
# Initialize PRU Config Reg with r0
# Read from Credit Reg
# Read from Credit Reg
/* Enable interrupt.1 */
lw r11, (apu_bcc)
nop
ori r11, r11,0x00001000
sw r11, (apu_bcc)
# Read APU BCC Register
# Write to BCC Reg to change
# interrupt polarity
nop
li r11, 0xf0400801
# Write to cp0 Status Reg, bev = 1,
# int.1 = 1, en-intr
mtc0 r11, $12
nop
/**********************************************************
Verify that the credit register is functioning properly
This is done for each CIR/PRPC timer using Interrupt.1
reporting Mechanism.
**********************************************************/
/* Disable interrupts */
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