- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377598 > L64360 (LSI Corporation) Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) PDF資料下載
參數(shù)資料
| 型號(hào)： | L64360 |
| 廠商： | LSI Corporation |
| 英文描述： | Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) |
| 中文描述： | 高度集成的自動(dòng)柜員機(jī)分段和重組（SAR）的網(wǎng)絡(luò)應(yīng)用（用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎） |
| 文件頁數(shù)： | 147/232頁 |
| 文件大?。?/td> | 1389K |
| 代理商： | L64360 |
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The ATMizer Architecture in Operation
12-15
Cell Generation
AlmostallaspectsofthecellgenerationprocessarecontrolledbytheATM
Processing Unit (APU) under user firmware control. To accomplish seg-
mentation, the APU functions as an event-driven device. A segmentation
triggeringeventcanbeanexternalevent,suchasthefillingofaDS1buffer
oraninternaleventsuchasthetimeoutofoneoftheteninternalPeakRate
Pacing Counters (PRPCs).
TheAPUdetectsexternaleventsbyperiodicallypollingaHost/DMAPort
or Secondary Port memory-mapped register that has a bit associated with
each possible external event, or by polling the GPINT_TST signal for an
indication that an external event has occurred. Polling GPINT_TST is a
faster mechanism because its state can be tested with a single APU instruc-
tion (Branch on Coprocessor Condition 0 True). However, since
GPINT_TST may be used as part of the Host-to-ATMizer messaging sys-
tem, the assertion of GPINT_TST may have to be qualified by access to a
message-type field or register somewhere in the Host/DMA Port or Sec-
ondary Port memory space. For the example in
Figure 12.4
, GPINT_TST
assertion might alert the ATMizer Architecture to a DS1 Buffer Full
Condition.
Ingeneral,internalPRPCtimeouteventsareusedtopacethesegmentation
of CS-PDUs while external events (GPINT_TST assertion) are used to
pace cell generation from realtime datastreams. When one or more
counters times out the Pacing Rate Unit responds by asserting the Copro-
cessor Condition 2 (CpCond2) input to the APU. The APU frequently
checks the state of this input by executing a single Branch on Coprocessor
Condition 2 True instruction. If the APU detects CpCond2 asserted, it
branches to the segmentation routine and reads in a 10-bit value from the
Channel Group Credit Register (CGCR) that indicates which counters
have expired. The APU can then proceed to segment the CS-PDUs associ-
ated with the Peak Rate Pacing Counters that have expired. Since the APU
can read the CGCR at any time, even in the midst of servicing a Channel
Group, the user is able to implement almost any channel priority scheme
that fits the application.
AAL 1 Realtime Datastreams
The ATMizer Architecture is capable of generating AAL 1 SAR-PDUs
from memory-mapped data buffers. In most cases, datastreams such as
DS1 lines will be terminated and synchronized to the ATMizer System
Clock, then prebuffered in dual 48-byte buffers in main memory. Once a
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