參數(shù)資料
型號(hào)： DS3112N
廠商： DALLAS SEMICONDUCTOR
元件分類： Digital Transmission Controller
英文描述： DATACOM, FRAMER, PBGA256
封裝： 27 X 27 MM, PLASTIC, BGA-256
文件頁數(shù)： 22/134頁
文件大小： 900K
代理商： DS3112N
DS3112
118 of 134
Parameter
Symbol
Min
Typ
Max
Units
Notes
CRD*, CWR* or CDS* Inactive
Time
t10
75
ns
Muxed Address Valid to CALE
Falling
t11
10
ns
2
Muxed Address Hold Time
t12
10
ns
2
CALE Pulse Width
t13
30
ns
2
Setup time for CALE high or muxed
address valid to CCS* active
t14
0
ns
2
NOTES:
1. In non-multiplexed bus applications (see Figure 12D), CALE should be tied high.
2. In multiplexed bus applications (see Figure 12E), CA[7:0] should be tied to CD[7:0] and the falling
edge of CALE will latch the address.
CPU BUS AC TIMING DIAGRAM (non-multiplexed) Figure 12D
Intel Read Cycle
Intel Write Cycle
Address Valid
Data Valid
CA[7:0]
CD[15:0]
CWR*
CCS*
CRD*
t1
t2
t3
t4
t5
t9
t10
Address Valid
CA[7:0]
CD[15:0]
CRD*
CCS*
CWR*
t1
t2
t6
t4
t7
t8
cpu_ac
t9
t10
相關(guān)PDF資料
PDF描述
DS3112 DATACOM, FRAMER, PBGA256
DS3131 SPECIALTY TELECOM CIRCUIT, PBGA256
DS3134 DATACOM, FRAMER, PBGA256
DS3150QN DATACOM, PCM TRANSCEIVER, PQCC28
DS3150Q DATACOM, PCM TRANSCEIVER, PQCC28
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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