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參數(shù)資料
| 型號： | MC68HC05PD6 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | PLASTIC, TQFP-80 |
| 文件頁數(shù)： | 8/165頁 |
| 文件大?。?/td> | 841K |
| 代理商： | MC68HC05PD6 |
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July 7, 1997
GENERAL RELEASE SPECIFICATION
MC68HC05PD6
SERIAL COMMUNICATIONS INTERFACE
MOTOROLA
REV 1.1
11-3
11.4
DATA FORMAT
Receive data in (RDI) or transmit data out (TDO) is the serial data presented
between the internal data bus and the output pin (TDO) and between the input pin
(RDI) and the internal data bus. Data format is as shown for the NRZ in
Figure 11-2 and must meet the following criteria:
1.
A high level indicates a logic one and a low level indicates a logic zero.
2.
The idle line is in a high (logic one) state prior to transmission/reception
of a message.
3.
A start bit (logic zero) is transmitted/received indicating the start of a
message.
4.
The data is transmitted and received least-signicant-bit rst.
5.
A stop bit (high in the tenth or eleventh bit position) indicates the byte is
complete.
6.
A break is dened as the transmission or reception of a low (logic zero)
for some multiple of the data format.
11.5
WAKE-UP FEATURE
In a typical multiprocessor conguration, the software protocol will usually identify
the addressee(s) at the beginning of the message. To permit uninterested MPUs
to ignore the remainder of the message, a wake-up feature is included, whereby
all further SCI receiver ag (and interrupt) processing can be inhibited until its
data line returns to the idle state. An SCI receiver is re-enabled by an idle string of
at least ten (or eleven) consecutive ones. Software for the transmitter must
provide for the required idle string between consecutive messages and prevent it
from occurring within messages.
A second wake-up method is available in which sleeping SCI receivers can be
awakened by a logic one in the high-order bit of a received character.
Figure 11-2. Data Format
0
123
456
8
IDLE LINE
0
7
*
START
STOP
START
CONTROL BIT M
SELECTS 8 OR 9 BIT DATA
* Stop bit is always high
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68HC705PD6 | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PQFP80 |
| MC68HC05PE0P | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDIP28 |
| MC68HC05PE0CDW | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDSO28 |
| MC68HC05PL4CSD | 8-BIT, MROM, 2.56 MHz, MICROCONTROLLER, PDSO28 |
| MC68HC705PL4BDW | 8-BIT, OTPROM, 2.56 MHz, MICROCONTROLLER, PDSO28 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68HC05PV8 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Techinal Data - rev 1.9 |
| MC68HC05PV8A | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Techinal Data - rev 1.9 |
| MC68HC05RC16 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:General Release Specification |
| MC68HC05RC16DW | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:General Release Specification |
| MC68HC05RC16FN | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:General Release Specification |
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