- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄45222 > MC68HC05PD6 (FREESCALE SEMICONDUCTOR INC) 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP80 PDF資料下載
參數(shù)資料
| 型號： | MC68HC05PD6 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | PLASTIC, TQFP-80 |
| 文件頁數(shù)： | 147/165頁 |
| 文件大小： | 841K |
| 代理商： | MC68HC05PD6 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁當前第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁
GENERAL RELEASE SPECIFICATION
July 7, 1997
MOTOROLA
TIMER SYSTEM
MC68HC05PD6
9-10
REV 1.1
9.1.4 Timer Control Register (TCR)
The TCR is a read/write register containing six control bits. Three bits control
interrupts associated with each of the three ag bits found in the timer status
register. The other two bits control: 1) which edge is signicant to the input capture
edge detector (i.e., negative or positive), and 2) the next value to be clocked to the
output level register in response to a successful output compare. The timer control
register and the free running counter are the only sections of the timer affected by
reset. The TCMP pin is forced low during external reset and stays low until a valid
compare changes it to high. The timer control register is illustrated below by a
denition of each bit.
ICIE
If the input capture interrupt enable (ICIE) bit is set, a timer interrupt is enable
when the ICF status ag is set, provided the I bit in CCR is cleared. If the ICIE
bit is cleared, the interrupt is inhibited. The ICIE bit is cleared by reset.
OC1IE
If the output compare interrupt enable (OC1IE) bit is set, a timer interrupt is
enabled whenever the OC1F status ag is set, provided the I bit in CCR is
cleared. If the OC1IE bit is cleared, the interrupt is inhibited. The OC1IE bit is
cleared by reset.
TOIE
If the timer overow interrupt enable (TOIE) bit is set, a timer interrupt is
enabled whenever the TOF status ag is set, provided the I bit in CCR is
cleared. If the TOIE bit is cleared, the interrupt
is inhibited. The TOIE bit is
cleared by reset.
OE1
The OE1 bit congures whether Port C bit 2 as I/O pin or as output pin of
TCMP.
0 =
PC2 is selected
1 =
TCMP is selected
IEDG
The value of the input edge (IEDG) bit determines which level transition on
TCAP pin will trigger a free running counter transfer to the input capture
register. Reset does not affect the IEDG bit.
0 =
negative edge
1 =
positive edge
0
ICIE
0
7
IEDG
00000
X
0
6543210
OE1
0
OLVL
W
R
TCR
$0012
reset
TOIE
OC1IE
相關PDF資料 |
PDF描述 |
|---|---|
| MC68HC705PD6 | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PQFP80 |
| MC68HC05PE0P | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDIP28 |
| MC68HC05PE0CDW | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDSO28 |
| MC68HC05PL4CSD | 8-BIT, MROM, 2.56 MHz, MICROCONTROLLER, PDSO28 |
| MC68HC705PL4BDW | 8-BIT, OTPROM, 2.56 MHz, MICROCONTROLLER, PDSO28 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MC68HC05PV8 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Techinal Data - rev 1.9 |
| MC68HC05PV8A | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Techinal Data - rev 1.9 |
| MC68HC05RC16 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:General Release Specification |
| MC68HC05RC16DW | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:General Release Specification |
| MC68HC05RC16FN | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:General Release Specification |
發(fā)布緊急采購，3分鐘左右您將得到回復。