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參數(shù)資料
| 型號(hào)： | MC68HC05PD6 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | PLASTIC, TQFP-80 |
| 文件頁數(shù)： | 107/165頁 |
| 文件大小： | 841K |
| 代理商： | MC68HC05PD6 |
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GENERAL RELEASE SPECIFICATION
July 7, 1997
MOTOROLA
RESETS
MC68HC05PD6
5-2
REV 1.1
the lower threshold and remains in reset until the RESET pin rises above the upper
threshold. This active low input will generate the RST signal and reset the CPU and
peripherals. Termination of the external RESET input can alter the operating mode of the
MCU.
NOTE
Activation of the RST signal is generally referred to as reset of the
device, unless otherwise specied.
5.2
INTERNAL RESETS
The three internally generated resets are the initial power-on reset, the COP Watchdog
Timer reset, and the illegal address reset
5.2.1 Power-On Reset (POR)
The internal POR is generated on power-up to allow the clock oscillator to stabilize. The
POR is strictly for power-on condition and is not able to detect a drop in the power supply
voltage (brown-out). There is an oscillator stabilization delay of 8072 OSC clock cycles
after the oscillator becomes active.
The POR will generate the RST signal which will reset the CPU. If any other reset function
is active at the end of this 8192 cycles delay, the RST signal will remain in the reset
condition until the other reset conditions end.
5.2.2 Computer Operating Properly Reset (COPR)
The internal COPR reset is generated automatically (if enabled) by a time-out of the COP
Watchdog Timer. This time-out occurs if the counter in the COP Watchdog Timer is not
reset (cleared) within a specific time by a program reset sequence. See Section 8 for
more information on this time-out feature.
5.2.3 Illegal Address Reset (ILADR)
The MCU monitors all opcode fetches. If an illegal address is accessed during an opcode
fetch, an internal reset is generated. Illegal address space consists of all unused locations
within the memory space and the I/O registers. (See Figure 2-1 for MC68HC05PD6
Memory Map.) Because the internal reset signal is used, the MCU comes out of an ILADR
Reset in the same operating mode it was in when the opcode was fetched.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| MC68HC05PE0CDW | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDSO28 |
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