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參數(shù)資料
| 型號： | MC68HC05PD6 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | PLASTIC, TQFP-80 |
| 文件頁數(shù)： | 121/165頁 |
| 文件大?。?/td> | 841K |
| 代理商： | MC68HC05PD6 |
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July 7, 1997
GENERAL RELEASE SPECIFICATION
MC68HC05PD6
INPUT/OUTPUT PORTS
MOTOROLA
REV 1.1
7-9
DWOML – Port D Open Drain Mode (L)
When this bit is set, the lower 4 bits of Port D are congured as open drain
outputs if the corresponding BP
x pin is not used by the LCD driver. This bit is
cleared on reset.
EWOMH – Port E Open Drain Mode (H)
When this bit is set, the upper 4 bits of Port E that are congured as I/O output
by the PEM
x bits in the PEMUX are congured as open drain outputs. This bit
is cleared on reset.
EWOML – Port E Open Drain Mode (L)
When this bit is set, the lower 4 bits of Port E that are congured as I/O output
by the PEM
x bits in the PEMUX are congured as open drain outputs. This bit
is cleared on reset.
AWOMH – Port A Open Drain Mode (H)
When this bit is set, upper 4 bits of Port A that are congured as output
(corresponding DDRA bit set) becomes open drain outputs. This bit is cleared
on reset.
AWOML – Port A Open Drain Mode (L)
When this bit is set, lower 4 bits of Port A that are congured as output
(corresponding DDRA bit set) becomes open drain outputs. This bit is cleared
on reset.
7.8.4 Open Drain Output Control Register 2 (WOM2)
CWOM
x – Port C Open Drain Mode (bit x)
When CWOM
x bit is set, Port C bit x are congured as open drain outputs if
DDRC
x is set. This bit is cleared on reset.
W
R
WOM2
$000B
reset
1
7
00
54
1
0000
6
3210
1
CWOM3
CWOM2
CWOM1
CWOM0
CWOM5
CWOM4
option
map
相關(guān)PDF資料 |
PDF描述 |
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