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參數(shù)資料
| 型號： | EC000UM |
| 英文描述： | EC000 Core User＇s Manual (SCM68000) |
| 中文描述： | EC000核心用戶手冊（SCM68000） |
| 文件頁數(shù)： | 90/145頁 |
| 文件大?。?/td> | 829K |
| 代理商： | EC000UM |
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Bus Operation
3-8
EC000 CORE PROCESSOR USER’S MANUAL
MOTOROLA
STATE 9
During state 9 (S9), ASB, UDSB, LDSB, and DSB are negated. The device negates
BERRB at this time.
3.1.2 Write Cycle
During a write cycle, the SCM68000 sends data to the memory or to a peripheral device.
The word write cycle flowchart is shown in Figure 3-7. The byte write cycle flowcharts for the
8-bit and 16-bit modes are shown in Figure 3-8 and Figure 3-9, respectively. The byte write
cycle timing diagram for the 8-bit mode of operation is shown in Figure 3-10. The word and
byte write cycle for the 16-bit mode of operation is shown in Figure 3-11.
Figure 3-7. Word Write Cycle Flowchart for 16-Bit Mode
BUS MASTER
ADDRESS THE DEVICE
1) PLACE FUNCTION CODE ON FC2–FC0
2) PLACE ADDRESS ON A31–A0
3) ASSERT ADDRESS STROBE (ASB)
4) SET RWB AND ERWB TO WRITE
5) PLACE DATA ON D15–D0
6) ASSERT UPPER DATA STROBE
(UDSB), LOWER DATA STROBE (LDSB),
AND DATA STROBE (DSB)
1) NEGATE UDSB, LDSB, AND DSB
2) NEGATE ASB
3) REMOVE DATA FROM D15–D0
4) SET RWB AND ERWB TO READ
TERMINATE THE CYCLE
INPUT THE DATA
1) DECODE ADDRESS
2) STORE DATA ON D15–D0
3) ASSERT DATA TRANSFER
ACKNOWLEDGE (DTACKB)
SLAVE
START NEXT CYCLE
TERMINATE OUTPUT TRANSFER
1) NEGATE DTACKB
F
re
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S
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c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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