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參數(shù)資料
| 型號： | SAA7108 |
| 廠商： | NXP Semiconductors N.V. |
| 元件分類： | Codec |
| 英文描述： | PC-CODEC |
| 中文描述： | PC的編解碼器 |
| 文件頁數(shù)： | 135/202頁 |
| 文件大?。?/td> | 983K |
| 代理商： | SAA7108 |
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2004 Mar 16
135
Philips Semiconductors
Product specification
PC-CODEC
SAA7108E; SAA7109E
Table 115
Subaddresses 81H to 83H
Table 116
Subaddresses 90H and 94H
Table 117
Subaddresses 91H and 94H
Table 118
Subaddresses 92H and 94H
Table 119
Subaddresses 93H and 94H
Table 120
Subaddresses 95H and 96H
Table 121
Subaddress 96H
DATA BYTE
DESCRIPTION
PCL
defines the frequency of the synthesized pixel clock PIXCLKO;
2
24
; f
XTAL
= 27 MHz nominal, e.g. 640
×
480 to NTSC M: PCL = 20F63BH;
640
×
480 to PAL B/G: PCL = 1B5A73H (as by strapping pins)
DATA BYTE
DESCRIPTION
XOFS
horizontal offset; defines the number of PIXCLKs from horizontal sync (HSVGC) output to composite
blanking (CBO) output
DATA BYTE
DESCRIPTION
XPIX
pixel in X direction; defines half the number of active pixels per input line (identical to the length of
CBO pulses)
DATA BYTE
DESCRIPTION
YOFSO
vertical offset in odd field; defines (in the odd field) the number of lines from VSVGC to first line with
active CBO; if no LUT data is requested, the first active CBO will be output at YOFSO + 2; usually,
YOFSO = YOFSE with the exception of extreme vertical downscaling and interlacing
DATA BYTE
DESCRIPTION
YOFSE
vertical offset in even field; defines (in the even field) the number of lines from VSVGC to first line with
active CBO; if no LUT data is requested, the first active CBO will be output at YOFSE + 2; usually,
YOFSE = YOFSO with the exception of extreme vertical downscaling and interlacing
DATA BYTE
DESCRIPTION
YPIX
defines the number of requested input lines from the feeding device;
number of requested lines = YPIX + YOFSE
YOFSO
DATA BYTE
LOGIC
LEVEL
DESCRIPTION
EFS
0
1
0
1
0
1
frame sync signal at pin FSVGC ignored in slave mode
frame sync signal at pin FSVGC accepted in slave mode
normal polarity of CBO signal (HIGH during active video)
inverted polarity of CBO signal (LOW during active video)
the SAA7108E; SAA7109E is timing master to the graphics controller
the SAA7108E; SAA7109E is timing slave to the graphics controller
PCBN
SLAVE
f
PIXCLK
PCL
f
XTAL
×
8
×
=
相關PDF資料 |
PDF描述 |
|---|---|
| SAA7109 | PC-CODEC |
| SAA7108E | PC-CODEC |
| SAA7109E | PC-CODEC |
| SAA7108AE | HD-CODEC |
| SAA7109A | HD-CODEC |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| SAA7108AE | 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:HD-CODEC |
| SAA7108E | 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:PC-CODEC |
| SAA7109 | 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:PC-CODEC |
| SAA7109A | 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:HD-CODEC |
| SAA7109AE | 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:HD-CODEC |
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