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參數(shù)資料
| 型號： | MC72000 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Integrated Bluetooth Radio |
| 中文描述： | 集成藍牙無線 |
| 文件頁數(shù)： | 121/156頁 |
| 文件大?。?/td> | 1782K |
| 代理商： | MC72000 |
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MOTOROLA
MC72000
Advance Information Data Sheet
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from the peripheral clock. The SSI clock generator consists of a selectable, fixed prescaler and a
programmable prescaler for bit rate clock generation. In gated clock mode, the data clock is valid only when
data is being transmitted (See Section 7.4.6.1.1.3, “Gated Clock Operation”). A programmable frame rate
divider and a word length divider are used for frame rate sync signal generation.
Figure 81 shows a block diagram of the clock generator for the transmit section. The serial bit clock can be
internal or external, depending on the transmit direction (TXDIR) bit in the SSI control register 2 (SCR2).
The receive section contains an equivalent clock generator circuit.
Figure 81. SSI Transmit Clock Generator Block Diagram
Figure 82 shows the frame sync generator block for the transmit section. When internally generated, both
receive and transmit frame sync are generated from the word clock and are defined by the frame rate divider
(DC[4:0]) bits and the word length (WL[1:0]) bits of the SSI transmit control register (STXCR). The receive
section contains an equivalent circuit for its frame sync generator.
Figure 82. SSI Transmit Frame Sync Generator Block Diagram
/2
IP_CLK
Prescaler
(/1 or /8)
Divider
(/1 to /256)
/2
TXDIR(1=output)
TXDIR(0=input)
Serial Bit Clock
TXDIR(1=output)
Word Length
Divider
Word Clock
WL[1:0]
PSR
PM[7:0]
/4
DIV4DIS
FIX_CLK
STCK
Frame
Rate
DC[4:0]
Frame
Sync
TFSL
TX
Control
TFSI
TFSI
TX Frame Sync Out
TX Frame Sync In
Word Clock
STFS
F
Freescale Semiconductor, Inc.
For More Information On This Product,
n
.
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