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參數(shù)資料
| 型號： | MC72000 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Integrated Bluetooth Radio |
| 中文描述： | 集成藍(lán)牙無線 |
| 文件頁數(shù)： | 101/156頁 |
| 文件大?。?/td> | 1782K |
| 代理商： | MC72000 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁當(dāng)前第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁
MOTOROLA
MC72000
Advance Information Data Sheet
Go to: www.freescale.com
101
7.4.5.2.12
SSI Test Register (STR)
This register controls test features and is not normally used.
Figure 64. STR Register Diagram
TEST—SSI Test Features
1 = SSI test features enabled.
0 = SSI test features disabled.
RCK2TCK—Receive Clock to Transmit Clock Loop Back
1 = Enables RX_CLK loop back to RX_CLK.
0 = Loop back is disabled.
RFS2TFS—Receive Frame to Transmit Frame Loop Back
1 = Enables RX_FRM loop back to TX_FRM.
0 = Loop back is disabled.
RXSTATE[4:0]—Receiver State Machine Status
These bit field indicates the receiver state machine status. These bits are used for test purpose only.
TXD2RXD—Transmit Data to Receive Data Loop Back
1 = Enables TXD loop back to RXD.
0 = Loop back is disabled.
TCK2RCK—Transmit Clock to Receive Clock Loop Back
1 = Enables TX_CLK loop back to RX_CLK.
0 = Loop back is disabled.
TFS2RFS—Transmit Frame to Receive Frame Loop Back
1 = Enables TX_FRM loop back to RX_FRM.
0 = Loop back is disabled.
TXSTATE[4:0]—Transmitter State Machine Status
This bit field indicates the transmitter state machine status. These bits are used for test purposes only.
8
1
0
0
0
0
0
0
0
0
Base + 0x10
15
14
13
12
11
RXSTATE[4:0]
10
9
8
7
6
5
4
3
TXSTATE[4:0]
2
1
0
R
W
TESTTCK
0
RFS2
TFS
0
TXD2
RXD
0
TCK2
RCK
0
TFS2
RFS
0
RESET:
0
1
0
0
0
1
1
0
0
0
0
= Unimplemented or Reserved
Table 50. Status of Transmit FIFO Empty Flag (Continued)
Transmit FIFO Watermark
(TFWM)
Number of data in TXFIFO
0
1
2
3
4
5
6
7
8
F
Freescale Semiconductor, Inc.
For More Information On This Product,
n
.
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