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參數(shù)資料
| 型號(hào)： | LXP710PE |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁(yè)數(shù)： | 32/84頁(yè) |
| 文件大小： | 1108K |
| 代理商： | LXP710PE |
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LXP710
—
HDSL Framer/Mapper for 1168 kbps Applications
32
Datasheet
Address: 0E
Abbreviation: L2TSCTL4
Read/Write
Address: 0F
Abbreviation: L3TSCTL1
Read/Write
Address: 10
Abbreviation: L3TSCTL2
Read/Write
Bit
Name
Default
Description
7
TSG16
1
Loop 2 Time Slot Grouping (Byte 3). Each bit that is set Low blocks transmission
of the corresponding DS0 channel in the mux E1 by forcing its bits to idle code.
6
TSG17
1
5
TSG18
0
4
TSG19
1
3
TSG20
0
2
TSG21
1
1
TSG22
0
0
TSG23
1
Table 16. Loop 2 Time Slot Control Byte 4
Bit
Name
Default
Description
7
TSG24
0
Loop 2 Time Slot Grouping (Byte 4). Each bit that is set Low blocks transmission
of the corresponding DS0 channel in the mux E1 by forcing its bits to idle code.
6
TSG25
1
5
TSG26
0
4
TSG27
1
3
TSG28
0
2
TSG29
1
1
TSG30
0
0
TSG31
1
Table 17. Loop 3 Time Slot Control Byte 1
Bit
Name
Default
Description
<7:0>
TSG<0:7>
0
Loop 3 Time Slot Grouping (Byte 1). Each bit that is set Low blocks transmission of
the corresponding DS0 channel in the mux E1 by forcing its bits to idle code.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| LXP730LE | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| LXT1000 | LAN TRANSCEIVER|SINGLE|HYBRID|BGA|492PIN|PLASTIC |
| LXT19908 | Amplifier. Other |
| LXT300JE | PCM Transceiver |
| LXT300NE | PCM Transceiver |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| LXP730 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Multi-Rate DSL Framer |
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| LXPB2SA-50SB-Q | 制造商:SMC Corporation of America 功能描述:Actuator, electric, ball bushing |
| LXPH0000 | 制造商:Red Lion Controls 功能描述:ANNUNCIATOR LABELS, 1 LPAX LABEL: PH 制造商:Red Lion Controls 功能描述:1 LPAX LABEL PH |
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