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參數(shù)資料
| 型號： | LXP710PE |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 21/84頁 |
| 文件大?。?/td> | 1108K |
| 代理商： | LXP710PE |
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HDSL Framer/Mapper for 1168 kbps Applications
—
LXP710
Datasheet
21
3.0
Register Definitions
Table 2
provides a summary of the LXP710 registers.
Table 3
through
Table 113
provide detailed
descriptions of each of the LXP710 register bits. The specified default values are set when the
LXP710 is reset by pin 7.
Table 2. Register Summary
Hex
Address
Decimal
Address
Symbol
Type
Description
00
0
MXE1CTL
R/W
Mux E1 control register
01
1
DXE1CTL
R/W
Demux E1 control register
02
2
LPCTL
R/W
HDSL loop control register
03
3
L1OHCTL
R/W
HDSL Loop 1 overhead control register
04
4
L2OHCTL
R/W
HDSL Loop 2 overhead control register
05
5
L3OHCTL
R/W
HDSL Loop 3 overhead control register
06
6
TSCTL
R/W
Time slot grouping table control register
07
7
L1TSCTL1
R/W
Loop 1 time slot control byte 1
08
8
L1TSCTL2
R/W
Loop 1 time slot control byte 2
09
9
L1TSCTL3
R/W
Loop 1 time slot control byte 3
0A
10
L1TSCTL4
R/W
Loop 1 time slot control byte 4
0B
11
L2TSCTL1
R/W
Loop 2 time slot control byte 1
0C
12
L2TSCTL2
R/W
Loop 2 time slot control byte 2
0D
13
L2TSCTL3
R/W
Loop 2 time slot control byte 3
0E
14
L2TSCTL4
R/W
Loop 2 time slot control byte 4
0F
15
L3TSCTL1
R/W
Loop 3 time slot control byte 1
10
16
L3TSCTL2
R/W
Loop 3 time slot control byte 2
11
17
L3TSCTL3
R/W
Loop 3 time slot control byte 3
12
18
L3TSCTL4
R/W
Loop 3 time slot control byte 4
13
19
IDLECODE
R/W
Programmable idle code bytes
14
20
PATCTL
R/W
QRSS test pattern control register
15
21
FMSYNC_PLLCTL
R/W
Frame pulse sync & PLL control register
16
22
PATSTAT
R/W
Test pattern error counter status register
17
23
DXPSSTAT
R/W
Demux power status register
18
24
DXHRPSTAT
R/W
Demux HDSL repeater present status register
19
25
DXLOSDSTAT
R/W
Demux loss of signal status register
1A
26
LPRSTAT
R/W
Loop reversal status register
1B
27
GENINTEN
R/W
General interrupt enable register
1C
28
GENINTSTAT
R/W
General interrupt status register
1D
29
6MSINTEN
R/W
6 ms interrupt enable register
1E
30
6MSINTSTAT
R/W
6 ms interrupt status register
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| LXP730LE | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| LXT1000 | LAN TRANSCEIVER|SINGLE|HYBRID|BGA|492PIN|PLASTIC |
| LXT19908 | Amplifier. Other |
| LXT300JE | PCM Transceiver |
| LXT300NE | PCM Transceiver |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| LXP730 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Multi-Rate DSL Framer |
| LXP730LE | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FRAMER/FORMATTER|CMOS|QFP|64PIN|PLASTIC |
| LXP80 | 制造商:Johnson Components 功能描述: |
| LXPB2SA-50SB-Q | 制造商:SMC Corporation of America 功能描述:Actuator, electric, ball bushing |
| LXPH0000 | 制造商:Red Lion Controls 功能描述:ANNUNCIATOR LABELS, 1 LPAX LABEL: PH 制造商:Red Lion Controls 功能描述:1 LPAX LABEL PH |
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