參數(shù)資料
型號(hào): IT8673F
廠商: Electronic Theatre Controls, Inc.
英文描述: GT 35C 35#12 SKT PLUG
中文描述: 先進(jìn)的輸入/輸出(高級(jí)I / O)的初步規(guī)范V0.5
文件頁(yè)數(shù): 29/128頁(yè)
文件大小: 780K
代理商: IT8673F
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IT8673F
19
Table 10-9. GPIO & Alternate Function Configuration Registers (cont’d)
LDN
Index
R/W
Reset
00h
00h
00h
Configuration Register or Action
07h
F5h
R/W
Simple I/O Enable Register
07h
F6h
R/W
Simple I/O Direction Selection Register
07h
F7h
R/W
Panel Button De-bounce Enable Register
07h
F8h
R/W
00h
Panel Button De-bounce Control Register / GP LED Blinking 2
Control Register
07h
F9h
R/W
00h
00h
00h
00h
00h
00h
00h
00h
00h
00h
00h
Keyboard Lock Pin Mapping Register
07h
FAh
R/W
GP LED Blinking 1 Pin Mapping Register
07h
FBh
R/W
GP LED Blinking Control & RING# Pin Mapping Register
07h
FCh
R/W
GP LED Blinking 2 Pin Mapping Register
07h
FDh
R/W
Reserved Register
07h
FEh
R/W
PCI CLKRUN# Pin Mapping Register
07h
FFh
R/W
SMI# Pin Mapping Register
07h
E0h
R/W
SMI# Control Register 1
07h
E1h
R/W
SMI# Control Register 2
07h
E2h
R
SMI# Status Register 1
07h
E3h
R-R/W
SMI# Status Register 2
Notes:
*1: All these registers can be read from all LDNs.
*2: When the ECP mode is not enabled, this register is
read only
as “04h”, and cannot be written.
*3: When bit 2 of the base address of Parallel Port is set to 1, the EPP mode cannot be enabled. Bit 0 of this register is
always 0.
*4: The initial value of the activate bit of KBC is determined by the latched state of DTR2# at the falling edge of the RESET
signal.
*5: These registers are
read only
unless the write enable bit (Index=F0h) is asserted.
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PDF描述
IT8687R GT 35C 35#12 SKT PLUG
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ITF87012SVT 6A, 20V, 0.035 Ohm, N-Channel,2.5V Specified Power MOSFET(6A, 20V, 0.035Ω N溝道2.5V專用功率MOS場(chǎng)效應(yīng)管)
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IT86G 制造商:未知廠家 制造商全稱:未知廠家 功能描述:TRIAC|600V V(DRM)|8A I(T)RMS|TO-220