參數(shù)資料
型號(hào)： AMD-8131
英文描述： AMD-8131 - AMD-8131 HyperTransport PCI-X Tunnel Data Sheet
中文描述： AMD的8131 -的AMD - 8131 HyperTransport的PCI - X的隧道數(shù)據(jù)表
文件頁數(shù)： 340/378頁
文件大小： 3300K
代理商： AMD-8131
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340
Registers
Chapter 4
AMD-8111 HyperTransport I/O Hub Data Sheet
24674
Rev. 3.00
April 2003
AMD Preliminary Information
LAN Ethernet Controller Physical Address
ENC160
Default:
Bits
47:0
0000_0000_0000h
Description
MAC Physical Address, PADR[47:0].
This register contains 48-bit, globally unique station address
assigned to this device. If the least signi
fi
cant bit of the
fi
rst byte of a received frame is 0, the
destination address of the frame is a unicast address, which is compared with the contents of the
PADR. If this bit is 0 and the frame
’
s destination address exactly matches the contents of PADR, the
frame is accepted and copied into the host system memory.
The byte order is such that PADR[7:0] corresponds to the
fi
rst address byte transferred over the
network.
Unicast address matching can be disabled by setting the Disable Receive Physical Address bit
(DCRVPA, bit 18 in CMD2). If DRCVPA is set to 1, a match of a frame
’
s destination address with the
contents of PADR does not cause the frame to be accepted and copied into the host memory.
Attribute:
Read-write; write mode R.
This register is reset by RESET_L.
LAN Ethernet Controller PHY Access
ENC0D0
Default:
Bits
31
0000_0000h
Description
PHY_CMD_ACTIVE. PHY Command Active
. Read-only. This bit is automatically set to 1 while the
PHY access logic is busy. The content of the PHY_DATA
fi
eld is invalid while this bit is 1.
PHY_WR_CMD. PHY Write Command
. Write-only. Setting this bit to 1 starts the process of writing
the data in the PHY_DATA
fi
eld to the external PHY register speci
fi
ed by the PHY_ADDR and
PHY_REG_ADDR
fi
elds.
PHY_RD_CMD. PHY Read Command
. Write-only. Setting this bit to 1 starts the process of reading
the external PHY register speci
fi
ed by the PHY_ADDR and PHY_REG_ADDR
fi
elds.
PHY_RD_ERR. PHY Read Error
. Read-only. This bit is automatically set if the previous command
was PHY_RD_CMD and a read error was detected.
Reserved.
PHY_PRE_SUP. Preamble Suppression
. Read-write. If this bit is set, the MII Management Frame is
sent without a preamble. Before setting this bit the host CPU must make sure that the external PHY
addressed by the PHY_ADDR
fi
eld is capable of accepting MII Management Frames without
preambles.
25:21
PHY_ADDR. PHY Address
. Read-write. The address of the external PHY device to be accessed.
20:16
PHY_REG_ADDR. PHY Register Address
. Read-write. The address of the register in the external
PHY device to be accessed.
15:0
PHY_DATA. PHY Data
. Read-write.Data written to or read from the external PHY register speci
fi
ed by
PHY_ADDR and PHY_REG_ADDR.
Attribute:
see below.
This register gives the host CPU indirect access to the MII Management Bus (MDC/MDIO). Through
this register the host CPU can read or write any external PHY register that is accessible through the
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AMD-8131BLCFW 制造商:Rochester Electronics LLC 功能描述:- Bulk
AMD-8131BLCT 制造商:Rochester Electronics LLC 功能描述:- Tape and Reel
AMD-8131BLCW 制造商:Rochester Electronics LLC 功能描述:- Bulk
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