參數(shù)資料
型號(hào)： AMD-8131
英文描述： AMD-8131 - AMD-8131 HyperTransport PCI-X Tunnel Data Sheet
中文描述： AMD的8131 -的AMD - 8131 HyperTransport的PCI - X的隧道數(shù)據(jù)表
文件頁(yè)數(shù)： 244/378頁(yè)
文件大?。?/td> 3300K
代理商： AMD-8131
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244
Registers
Chapter 4
AMD-8111 HyperTransport I/O Hub Data Sheet
24674
Rev. 3.00
April 2003
AMD Preliminary Information
GPIO Output Clock 0 and 1 Register
PMBC
This register specifies the High time and the Low time for the GPIO output clocks. These clocks can
be selected as the output for any of the GPIO pins. These output clocks consist of a 7-bit down
counter that is alternately loaded with the High time and the Low time. The clock for the counters is
selected by CLK[1,0]BASE.
Default:
FFFF FFFFh.
Attribute:
Read-write.
General Purpose I/O Pins GPIO[31:0] Select Registers
PM[DF:C0]
See Section 3.7.5 on page 66 for details about the GPIO hardware.
Usage note: to set a GPIO pin as a software-controlled output, its corresponding GPIO register should
be written with the value 04h for a Low and the value 05h for a High.
Default:
Offset:
See the MODE field definition.
DFh-C0h (one single-byte register for each GPIO pin).
Attribute:
Seebelow.
Bits
31:30
CLK1BASE.
See bits[15:14].
29:23
CLK1HI.
See bits[13:7].
22:16
CLK1LO.
See bits[6:0].
15:14
CLK0BASE. GPIO output clock timer base.
Speci
fi
es the clock for the counter that generates the
GPIO output clock. 00b=250 microseconds; 01b=2 milliseconds; 10b=16 milliseconds; 11b=128
milliseconds. CLK0BASE speci
fi
es the clock for GPIO output clock 0 and CLK1BASE speci
fi
es the
clock for GPIO output clock 1.
13:7
CLK0HI. GPIO output clock High time.
Speci
fi
es the High time for the GPIO output clocks in
increments of clock speci
fi
ed by CLK[1,0]BASE (if the base is 16 milliseconds, then 0 speci
fi
es 16
milliseconds, 1 speci
fi
es 32 milliseconds, etc.). CLK0HI speci
fi
es the High time for GPIO output clock
0 and CLK1HI speci
fi
es the High time for GPIO output clock 1.
6:0
CLK0LO. GPIO output clock Low time.
Speci
fi
es the Low time for the GPIO output clocks in
increments of the clock speci
fi
ed by CLK[1,0]BASE (if the base is 16 milliseconds, then 0 speci
fi
es 16
milliseconds, 1 speci
fi
es 32 milliseconds, etc.). CLK0LO speci
fi
es the Low time for GPIO output clock
0 and CLK1LO speci
fi
es the Low time for GPIO output clock 1.
Description
Bits
7
6
Description
Reserved.
LTCH_STS. GPIO latch status.
Read; set by hardware; write 1 to clear. This provides the current
state of the latch associated with the input path for the GPIO pin that corresponds to the register.
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