參數(shù)資料
型號： AMD-8131
英文描述： AMD-8131 - AMD-8131 HyperTransport PCI-X Tunnel Data Sheet
中文描述： AMD的8131 -的AMD - 8131 HyperTransport的PCI - X的隧道數(shù)據(jù)表
文件頁數(shù)： 219/378頁
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代理商： AMD-8131
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Chapter 4
Registers
219
24674
Rev. 3.00
April 2003
AMD-8111 HyperTransport I/O Hub Data Sheet
AMD Preliminary Information
Programmable I/O Range Monitor Trap Mask Register
DevB:3xCC
Default:
0000 0000h.
Attribute:
Read-write.
Programmable Memory/Con
fi
guration Range Monitor 1 Trap Address Register
DevB:3xD0
DevB:3xD0, DevB:3xD4, and DevB:3xD8 combine to specify the address space for the
programmable memory or configuration space range monitor 1 and 2 trap events (PMEMRM[1,2]).
These events can be used to generate SMIs or SCIs, load the associated re-trigger timers (PM88 and
PM8C), or load the system inactivity timer. These trap events occur when the following equations are
true:
PMEMRM1:
(AD[31:2] | MASKMEM1 == ADDRMEM1[31:2] | MASKMEM1) & MEMSP & ~CFGSPEN1
| (AD[15:2] | MASKMEM1 == ADDRMEM1[15:2] | MASKMEM1) & CFGSP &
~AD[24] & ~ADDRMEM1[24]
| (AD[23:2] | MASKMEM1 == ADDRMEM1[23:2] | MASKMEM1) & CFGSP &
AD[24] &
ADDRMEM1[24];
PMEMRM2:
(AD[31:2] | MASKMEM2 == ADDRMEM2[31:2] | MASKMEM2) & MEMSP & ~CFGSPEN2
| (AD[15:2] | MASKMEM2 == ADDRMEM2[15:2] | MASKMEM2) & CFGSP &
~AD[24] & ~ADDRMEM2[24]
| (AD[23:2] | MASKMEM2 == ADDRMEM2[23:2] | MASKMEM2) & CFGSP &
AD[24] &
ADDRMEM1[24];
CFGSPEN1 &
CFGSPEN1 &
CFGSPEN2 &
CFGSPEN2 &
Where AD is the address field of a host transaction, MEMSP indicates a memory space transaction
and CFGSP indicates a configuration space transaction. The mask bits cover address bits[17:2]. Note
that for configuration traps, AD[24] and ADDRMEM[2,1][24] carry the determination of whether the
trap is a type 0 or type 1 configuration cycle; if it is type 0, then the bus number bits are ignored.
Default:
0000 0000h.
Attribute:
Read-write.
Bits
31:24
MASKIO4. Address masks for the PIORM4 trap events
. See DevB:3xC4 for details.
23:16
MASKIO3. Address masks for the PIORM3 trap events
. See DevB:3xC4 for details.
15:8
MASKIO2. Address masks for the PIORM2 trap events
. See DevB:3xC4 for details.
7:0
MASKIO1. Address masks for the PIORM1 trap events
. See DevB:3xC4 for details.
Description
Bits
31:2
1
0
Description
ADDRMEM1. Memory address for the PMEMRM1 trap event
.
Reserved.
CFGSPEN1. Con
fi
guration space enable 1.
1=PMEMRM1 is a con
fi
guration space trap.
0=PMEMRM1 is a memory space trap.
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