參數(shù)資料
型號： AMD-8131
英文描述： AMD-8131 - AMD-8131 HyperTransport PCI-X Tunnel Data Sheet
中文描述： AMD的8131 -的AMD - 8131 HyperTransport的PCI - X的隧道數(shù)據(jù)表
文件頁數(shù)： 339/378頁
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代理商： AMD-8131
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Chapter 4
Registers
339
24674
Rev. 3.00
April 2003
AMD-8111 HyperTransport I/O Hub Data Sheet
AMD Preliminary Information
LAN Ethernet Controller MIB Address
ENC14
Default:
Bits
15
0000h
Description
MIB_CMD_ACTIVE. Command Active
. Read-only. A value of 1 indicates that an access cycle is in
progress. The host CPU must not write to this register while this bit is 1. A value of 0 indicates that the
previous access cycle has completed and a new access cycle may be started.
Reserved.
MIB_RD_CMD. Read Command
. Read, write 1b to clear; write mode R. Setting this bit to 1 starts a
read access cycle.
MIB_CLEAR.
Read, write 1b to clear; write mode R. Setting this bit to 1 causes all MIB locations to be
set to all zeros.
Reserved.
MIB_ADDRESS.
Read-write; write mode R. The address of the desired table entry.
Attribute:
see below.
Used for indirect access to the MIB_DATA register. This register is reset by RESET_L.
LAN Ethernet Controller MIB Data Access
ENC10
Default:
Bits
31:0
_h
Description
MIB_DATA. MIB register contents
. May be cleared using MIB_CLEAR bit in MIB_ADDR register.
Attribute:
Read-only.
Access to this data register is indirect by way of the MIB_ADDR register. Protocol is similar to PHY
access protocol except no interrupt is available as accesses end within a short time. The access
protocol for a read access is:
1. Read MIB_ADDR until MIB_CMD_ACTIVE is 0.
2.
Write MIB_ADDR with MIB_RD_CMD = 1 and MIB_ADDR set to the desired address.
3.
Read MIB_ADDR until MIB_CMD_ACTIVE is 0. The value is in the MIB_DATA register.
Data transfers are 32 bits wide for MIB.
14
13
12
11:6
5:0
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AMD-8131BLCFW 制造商:Rochester Electronics LLC 功能描述:- Bulk
AMD-8131BLCT 制造商:Rochester Electronics LLC 功能描述:- Tape and Reel
AMD-8131BLCW 制造商:Rochester Electronics LLC 功能描述:- Bulk
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