參數(shù)資料
型號： AMD-8131
英文描述： AMD-8131 - AMD-8131 HyperTransport PCI-X Tunnel Data Sheet
中文描述： AMD的8131 -的AMD - 8131 HyperTransport的PCI - X的隧道數(shù)據(jù)表
文件頁數(shù)： 28/378頁
文件大小： 3300K
代理商： AMD-8131
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁當(dāng)前第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁第280頁第281頁第282頁第283頁第284頁第285頁第286頁第287頁第288頁第289頁第290頁第291頁第292頁第293頁第294頁第295頁第296頁第297頁第298頁第299頁第300頁第301頁第302頁第303頁第304頁第305頁第306頁第307頁第308頁第309頁第310頁第311頁第312頁第313頁第314頁第315頁第316頁第317頁第318頁第319頁第320頁第321頁第322頁第323頁第324頁第325頁第326頁第327頁第328頁第329頁第330頁第331頁第332頁第333頁第334頁第335頁第336頁第337頁第338頁第339頁第340頁第341頁第342頁第343頁第344頁第345頁第346頁第347頁第348頁第349頁第350頁第351頁第352頁第353頁第354頁第355頁第356頁第357頁第358頁第359頁第360頁第361頁第362頁第363頁第364頁第365頁第366頁第367頁第368頁第369頁第370頁第371頁第372頁第373頁第374頁第375頁第376頁第377頁第378頁
28
Signal Descriptions
Chapter 2
AMD-8111 HyperTransport I/O Hub Data Sheet
24674
Rev. 3.00
April 2003
AMD Preliminary Information
SLPBTN_L.
Sleep button input. This may be used to control
the automatic transition from a sleep state to FON. It controls
PM00[SLPBTN_STS]. Also, if it is asserted for four seconds
from any state other than SOFF, then a power button
override event is generated. A power button override event
causes the PWRON_L pin to be driven High and
PM00[PBOR_STS] to be set High. The logic for this pin
includes a debounce circuit. When the signal is asserted
High or Low for less than 12 milliseconds, the debounce
logic does not propagate a change of the signal value to the
internal logic; the signal must be asserted for at least 16
milliseconds to be safely detected by the internal logic. This
pin may be configured as GPIO23 by PMD7.
SMBALERT0_L.
SMBus 1.0 alert input. This may be used to
generate an SMI or SCI interrupt or a resume event
associated with the SMBus logic. This pin may be configured
as GPIO22 by PMD6. Note: although this pin resides on the
VDD_IOX power plane, it can only be used for the SMBus
alert function while the main power supply is valid.
SMBALERT1_L.
SMBus 2.0 alert input. This may be used to
generate an SMI or SCI interrupt or a resume event
associated with the SMBus logic. This pin may be configured
as GPIO24 by PMD8.
SMBUSC[1:0].
System management bus (SMBus) clock.
SMBUSC[0] is associated with the SMBus 1.0 host controller
and SMBUSC[1] is associated with the SMBus 2.0 host
controller. The logic for the SMBUSC1 pin includes a
debounce circuit. When the signal is asserted High or Low
for less than 80 nanoseconds, the debounce logic does not
propagate a change of the signal value to the internal logic;
the signal must be asserted for at least 100 nanoseconds to
be safely detected by the internal logic.
SMBUSD[1:0].
System management bus (SMBus) data.
SMBUSD[0] is associated with the SMBus 1.0 host controller
and SMBUSD[1] is associated with the SMBus 2.0 host
controller. The logic for the SMBUSD1 pin includes a
debounce circuit. When the signal is asserted High or Low
for less than 80 nanoseconds, the debounce logic does not
propagate a change of the signal value to the internal logic;
the signal must be asserted for at least 100 nanoseconds to
be safely detected by the internal logic.
I,
IO
VDD_
IOX
I, IO
VDD_
IOX
I, IO
VDD_
IOX
IOD
VDD_
IOX
3-State 3-State Func.
Func.
IOD
VDD_
IOX
3-State 3-State Func.
Func.
Table 6.
System Management Pin Descriptions (Continued)
Pin Name and Description
I/O
Cell
Type
Power
Plane
During
Reset
After
Reset
During
POS
During
S3:S5
相關(guān)PDF資料
PDF描述
AMD-8151 AMD-8151 - Preliminary AMD-8151 HyperTransport AGP3.0 Graphics Tunnel Data Sheet
AMD64 AMD64 Architecture Programmer＇s Manual Volume 1: Application Programming
AMDATHLON AMD Athlon - AMD Athlon Processor Model 4 Revision Guide
AMDATHLON64 AMD Athlon 64 - Report of Management on Processor Performance Benchmarks AMD Athlon 64 Processor 3200+
AMDATHLONMP AMD Athlon MP - AMD Athlon MP Processor Model 6 Data Sheet
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
AMD-8131BLC 制造商:Advanced Micro Devices 功能描述: 制造商:Advanced Micro Devices 功能描述:PCI BUS CONTROLLER, PBGA829
AMD-8131BLCFT 制造商:Rochester Electronics LLC 功能描述:- Tape and Reel
AMD-8131BLCFW 制造商:Rochester Electronics LLC 功能描述:- Bulk
AMD-8131BLCT 制造商:Rochester Electronics LLC 功能描述:- Tape and Reel
AMD-8131BLCW 制造商:Rochester Electronics LLC 功能描述:- Bulk
發(fā)布緊急采購，3分鐘左右您將得到回復(fù)。

采購需求

(若只采購一條型號，填寫一行即可)

發(fā)布成功！您可以繼續(xù)發(fā)布采購。也可以進入我的后臺，查看報價

發(fā)布成功！您可以繼續(xù)發(fā)布采購。也可以進入我的后臺，查看報價

*型號 *數(shù)量 廠商 批號 封裝
添加更多采購

我的聯(lián)系方式

*
*
*