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參數(shù)資料
| 型號： | R5F213G2MNNP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQCC24 |
| 封裝： | 4 X 4 MM, 0.50MM PITCH, HWQFN-24 |
| 文件頁數(shù)： | 349/623頁 |
| 文件大?。?/td> | 6051K |
| 代理商： | R5F213G2MNNP |
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R8C/3GM Group
25. I2C bus Interface
R01UH0284EJ0100 Rev.1.00
Page 384 of 591
Aug 09, 2011
25. I2C bus Interface
The I2C bus interface is the circuit that performs serial communication based on the data transfer format of the Philips
I2C bus.
25.1
Overview
Table 25.1 lists the I2C bus Interface Specifications, Figure 25.1 shows an I2C bus interface Block Diagram, and
Figure 25.2 shows the External Circuit Connection Example of Pins SCL and SDA, Table 25.2 lists the Pin
Note:
1. All sources use one interrupt vector for I2C bus interface.
Table 25.1
I2C bus Interface Specifications
Item
Specification
Communication formats I2C bus format
- Selectable as master/slave device.
- Continuous transmit/receive operation (because the shift register, transmit
data register, and receive data register are independent.)
- Start/stop conditions are automatically generated in master mode.
- Automatic loading of the acknowledge bit during transmission
- Bit synchronization/wait function (In master mode, the state of the SCL
signal is monitored per bit and the timing is synchronized automatically. If
the transfer is not possible yet, the SCL signal goes “L” and the interface
stands by.)
- Support for direct drive of pins SCL and SDA (N-channel open-drain output)
Clock synchronous serial format
- Continuous transmit/receive operation (because the shift register, transmit
data register, and receive data register are independent.)
I/O pins
SCL (I/O): Serial clock I/O pin
SDA (I/O): Serial data I/O pin
Transfer clocks
When the MST bit in the ICCR1 register is set to 0.
External clock (input from the SCL pin)
When the MST bit in the ICCR1 register is set to 1.
Internal clock selected by bits CKS0 to CKS3 in the ICCR1 register and bits
IICTCTWI and IICTCHALF in the PINSR register (output from the SCL pin)
Receive error detection
Overrun error detection (clock synchronous serial format)
Indicates an overrun error during reception. When the last bit of the next unit
of data is received while the RDRF bit in the ICSR register is set to 1 (data in
the ICDRR register), the AL bit is set to 1.
Interrupt sources
Transmit data empty (including when slave address matches), end of
transmission, receive data full (including when slave address matches),
arbitration lost, NACK detection, and stop condition detection
Clock synchronous serial format ...... 4 sources (1)
Transmit data empty, end of transmission, receive data full, and overrun error
Selectable functions
I2C bus format
- Selectable output level for the acknowledge signal during reception.
Clock synchronous serial format
- MSB-first or LSB-first selectable as the data transfer direction.
SDA digital delay
- Digital delay value for the SDA pin selectable by bits SDADLY0 to
SDADLY1 in the PINSR register.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| R5F213G4DDSP | 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO24 |
| R5F213G2DNSP | 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO24 |
| R5F213G5DDSP | 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO24 |
| R5F213J2CNNP | MICROCONTROLLER, QCC36 |
| R5F213J4ANNP | 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQCC36 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| R5F213G2MNNP#U0 | 制造商:Renesas Electronics Corporation 功能描述:R8C/3GM 8+4/1 24HWQFN 4X4 -20 TO +85 - Trays 制造商:Renesas Electronics Corporation 功能描述:IC MCU 16BIT 8KB FLASH 24QFN |
| R5F213G4ADNP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU |
| R5F213G4ANNP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU |
| R5F213G4CDNP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU |
| R5F213G4CDSP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU |
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