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參數(shù)資料
| 型號： | R5F213G2MNNP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQCC24 |
| 封裝： | 4 X 4 MM, 0.50MM PITCH, HWQFN-24 |
| 文件頁數(shù)： | 304/623頁 |
| 文件大?。?/td> | 6051K |
| 代理商： | R5F213G2MNNP |
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R8C/3GM Group
22. Serial Interface (UART2)
R01UH0284EJ0100 Rev.1.00
Page 344 of 591
Aug 09, 2011
22.6
Multiprocessor Communication Function
When the multiprocessor communication function is used, data transmission/reception can be performed between a
number of processors sharing communication lines by asynchronous serial communication, in which a
multiprocessor bit is added to the data. For multiprocessor communication, each receiving station is addressed by a
unique ID code. The serial communication cycle consists of two component cycles; an ID transmission cycle for
specifying the receiving station, and a data transmission cycle for the specified receiving station. The
multiprocessor bit is used to differentiate between the ID transmission cycle and the data transmission cycle. When
the multiprocessor bit is set to 1, the cycle is an ID transmission cycle; when the multiprocessor bit is set to 0, the
cycle is a data transmission cycle. Figure 22.17 shows an Inter-Processor Communication Example Using
The transmitting station first sends the ID code of the receiving station to perform communication as
communication data with a 1 multiprocessor bit added. It then sends transmit data as communication data with a 0
multiprocessor bit added.
When communication data in which the multiprocessor bit is 1 is received, the receiving station compares that data
with its own ID. If they match, the data to be sent next is received. If they do not match, the receive station
continues to skip communication data until data in which the multiprocessor bit is 1 is again received.
UART2 uses the MPIE bit in the U2SMR5 register to implement this function. When the MPIE bit is set to 1, data
transfer from the UART2 receive register to the U2RB register, receive error detection, and the settings of the
status flags, the RI bit in the U2C1 register, bits FER and OER in the U2RB register, are disabled until data in
which the multiprocessor bit is 1 is received. On receiving a receive character in which the multiprocessor bit is 1,
the MPRB bit in the U2RB register is set to 1 and the MPIE in the U2SMR5 register bit is set to 0, thus normal
reception is resumed.
When the multiprocessor format is specified, the parity bit specification is invalid. All other bit settings are the
same as those in normal asynchronous mode (UART mode). The clock used for multiprocessor communication is
the same as that in normal asynchronous mode (UART mode).
Figure 22.17
Inter-Processor Communication Example Using Multiprocessor Format
(Data AAh Transmission to Receiving Station A)
01h
Serial data
AAh
(MPRB = 1)
(MPRB = 0)
ID transmission cycle
= receiving station
specification
Data transmission cycle
= data transmission to
receiving station
specified by ID
MPRB: Multiprocessor bit
(ID = 01)
(ID = 02)
(ID = 03)
(ID = 04)
Receiving
station A
Receiving
station B
Receiving
station C
Receiving
station D
Transmitting
station
Communication line
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| R5F213G4DDSP | 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO24 |
| R5F213G2DNSP | 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO24 |
| R5F213G5DDSP | 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO24 |
| R5F213J2CNNP | MICROCONTROLLER, QCC36 |
| R5F213J4ANNP | 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQCC36 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| R5F213G2MNNP#U0 | 制造商:Renesas Electronics Corporation 功能描述:R8C/3GM 8+4/1 24HWQFN 4X4 -20 TO +85 - Trays 制造商:Renesas Electronics Corporation 功能描述:IC MCU 16BIT 8KB FLASH 24QFN |
| R5F213G4ADNP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU |
| R5F213G4ANNP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU |
| R5F213G4CDNP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU |
| R5F213G4CDSP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU |
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