參數(shù)資料
型號(hào)： R5F213G2MNNP
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQCC24
封裝： 4 X 4 MM, 0.50MM PITCH, HWQFN-24
文件頁(yè)數(shù)： 115/623頁(yè)
文件大?。?/td> 6051K
代理商： R5F213G2MNNP
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R8C/3GM Group
15. DTC
R01UH0284EJ0100 Rev.1.00
Page 173 of 591
Aug 09, 2011
15.3
Function Description
15.3.1
Overview
When the DTC is activated, control data is read from the DTC control data area to perform data transfers and
control data after data transfer is written back to the DTC control data area. Twenty-four sets of control data can
be stored in the DTC control data area, which allows 24 types of data transfers to be performed.
There are two transfer modes: normal mode and repeat mode. When the CHNE bit in the DTCCRj (j = 0 to 23)
register is set to 1 (chain transfers enabled), multiple control data is read and data transfers are continuously
performed by one activation source (chain transfers).
A transfer source address is specified by the 16-bit register DTSARj, and a transfer destination address is
specified by the 16-bit register DTDARj. The values in the registers DTSARj and DTDARj are separately fixed
or incremented according to the control data on completion of the data transfer.
15.3.2
Activation Sources
The DTC is activated by an interrupt source. Figure 15.2 is a Block Diagram Showing Control of DTC
The interrupt sources to activate the DTC are selected with the DTCENi (i = 0 to 3, 5 to 6) registers.
The DTC sets 0 (activation disabled) to the corresponding bit among bits DTCENi0 to DTCENi7 in the
DTCENi register during operation when the setting of data transfer (the first transfer in chain transfers) is either
of the following:
Transfer causing the DTCCTj (j = 0 to 23) register value to change to 0 in normal mode
Transfer causing the DTCCTj register value to change to 0 while the RPTINT bit in the DTCCRj register is 1
(interrupt generation enabled) in repeat mode
If the data transfer setting is not either of the above and the activation source is an interrupt source for timer RC,
or the flash memory, the DTC sets 0 to the interrupt source flag corresponding to the activation source during
operation.
If multiple activation sources are simultaneously generated, the DTC activation will be performed according to
the DTC activation source priority.
If multiple activation sources are simultaneously generated on completion of DTC operation, the next transfer
will be performed according to the priority.
DTC activation is not affected by the I flag or interrupt control register, unlike with interrupt request operation.
Therefore, even if interrupt requests cannot be acknowledged because interrupts are disabled, DTC activation
requests can be acknowledged. The IR bit in the interrupt control register does not change even when an
interrupt source to enable DTC activation is generated.
Figure 15.2
Block Diagram Showing Control of DTC Activation Sources
Interrupt controller
Select interrupt source or
DTC activation source
DTCENi
Clear control
Peripheral function 1
Peripheral function 2
(timer RC, flash memory)
DTC
Interrupt request
Peripheral interrupt
request
Peripheral interrupt
request
DTC activation
request
Select DTC activation or
interrupt generation.
Set the bit among bits DTCENi0 to
DTCENi7 (i = 0 to 3, 5 to 6) to 0.
Set the interrupt source flag
in the status register to 0.
相關(guān)PDF資料
PDF描述
R5F213G4DDSP 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO24
R5F213G2DNSP 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO24
R5F213G5DDSP 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO24
R5F213J2CNNP MICROCONTROLLER, QCC36
R5F213J4ANNP 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQCC36
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R5F213G4CDNP 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU
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