參數(shù)資料
型號(hào)： R5F213G2MNNP
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQCC24
封裝： 4 X 4 MM, 0.50MM PITCH, HWQFN-24
文件頁數(shù)： 120/623頁
文件大小： 6051K
代理商： R5F213G2MNNP
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R8C/3GM Group
15. DTC
R01UH0284EJ0100 Rev.1.00
Page 178 of 591
Aug 09, 2011
Figure 15.5
DTC Internal Operation Flowchart When DTC Activation Source is SSU/I2C bus
Receive Data Full
Figure 15.6
DTC Internal Operation Flowchart When DTC Activation Source is SSU/I2C bus
Transmit Data Empty
DTC activation source generation
NMIF = 1?
Read DTC vector
Read control data
Transfer data
(Reading the receive data register
sets the RDRF bit to 0) (1)
Write back control data
CHNE=1?
Branch 1
0 is written to the bit among bits DTCENi0 to DTCENi7 and an interrupt request is generated
when transfer is either of the following:
- Transfer causing the DTCCTj (j = 0 to 23) register value to change from 1 to 0 in normal mode
- Transfer causing the DTCCTj register value to change from 1 to 0 while the RPTINT bit is 1 in
repeat mode
Yes
No
DTCENi0 to DTCENi7: Bits in DTCENi (i = 0 to 3, 5 to 6) registers
RPTINT, CHNE: Bits in DTCCRj registers
NMIF: Bit in DTCTL register
RDRF: Bit in SSSR/ICSR register
Branch 1
End
No
Yes
Read control data
Transfer data
(Reading the receive data register
sets the RDRF bit to 0) (1)
Write back control data
CHNE=1?
No
Write 0 to the bit among
DTCENi0 to DTCENi7
Generate an interrupt request
for the CPU
Transfer data
(Reading the receive data register
does not set the RDRF bit to 0)
Write back control data
CHNE=1?
Yes
No
Interrupt handling
Read control data
Transfer data
(Reading the receive data register
does not set the RDRF bit to 0)
Write back control data
CHNE=1?
Yes
No
Note:
1. When the DTC activation source is SSU/I2C bus receive data full, the DTC does not set the RDRF bit in the SSSR register/the ICSR register to 0.
Instead, reading the receive data register during DTC data transfer sets the RDRF bit to 0.
DTC activation source generation
NMIF = 1?
Read DTC vector
Read control data
Transfer data
(writing the transmit data register
sets the TDRE bit to 0) (1)
Write back control data
CHNE=1?
Branch 1
0 is written to the bit among bits DTCENi0 to DTCENi7 when transfer is either of the following:
- Transfer causing the DTCCTj (j = 0 to 23) register value to change from 1 to 0 in normal mode
- Transfer causing the DTCCTj register value to change from 1 to 0 while the RPTINT bit is 1 in
repeat mode
Yes
No
DTCENi0 to DTCENi7: Bits in DTCENi (i = 0 to 3, 5 to 6) registers
RPTINT, CHNE: Bits in DTCCRj registers
NMIF: Bit in DTCTL register
TDRE: Bit in SSSR/ICSR register
Branch 1
End
No
Yes
Read control data
Transfer data
(writing the transmit data register
sets the TDRE bit to 0) (1)
Write back control data
CHNE=1?
No
Write 0 to the bit among
DTCENi0 to DTCENi7
Transfer data
(writing the transmit data register
sets the TDRE bit to 0) (1)
Write back control data
CHNE=1?
Yes
No
Read control data
Transfer data
(writing the transmit data register
sets the TDRE bit to 0) (1)
Write back control data
CHNE=1?
Yes
No
Note:
1. When the DTC activation source is SSU/I2C bus transmit data empty, the DTC does not set the TDRE bit in the SSSR register/the ICSR register to 0.
Instead, writing data to the transmit data register during DTC data transfer sets the TDRE bit to 0.
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PDF描述
R5F213G4DDSP 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO24
R5F213G2DNSP 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO24
R5F213G5DDSP 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO24
R5F213J2CNNP MICROCONTROLLER, QCC36
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R5F213G4ADNP 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU
R5F213G4ANNP 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU
R5F213G4CDNP 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU
R5F213G4CDSP 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU
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