參數(shù)資料
型號(hào)： R5F213G2MNNP
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQCC24
封裝： 4 X 4 MM, 0.50MM PITCH, HWQFN-24
文件頁(yè)數(shù)： 106/623頁(yè)
文件大小： 6051K
代理商： R5F213G2MNNP
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R8C/3GM Group
14. Watchdog Timer
R01UH0284EJ0100 Rev.1.00
Page 166 of 591
Aug 09, 2011
14.3.3
Count Source Protection Mode Enabled
The count source for the watchdog timer is the low-speed on-chip oscillator clock for the watchdog timer when
count source protection mode is enabled. If the CPU clock stops when a program is out of control, the clock can
still be supplied to the watchdog timer.
Notes:
1. The WDTON bit cannot be changed by a program. To set this bit, write 0 to bit 0 of address 0FFFFh
with a flash programmer.
2. Even if 0 is written to the CSPROINI bit in the OFS register, the CSPRO bit is set to 1. The
CSPROINI bit cannot be changed by a program. To set this bit, write 0 to bit 7 of address 0FFFFh
with a flash programmer.
3. Write the WDTR register during the count operation of the watchdog timer.
Table 14.3
Watchdog Timer Specifications (Count Source Protection Mode Enabled)
Item
Specification
Count source
Low-speed on-chip oscillator clock
Count operation
Decrement
Period
Count value of watchdog timer (m)
Low-speed on-chip oscillator clock for the watchdog timer
m: Value set by bits WDTUFS0 and WDTUFS1 in the OFS2 register
Example:
The period is approximately 8.2 ms when:
- The on-chip oscillator clock for the watchdog timer is set to 125 kHz.
- Bits WDTUFS1 to WDTUFS0 are set to 00b (03FFh).
Watchdog timer
initialization conditions
Reset
Write 00h and then FFh to the WDTR register. (3)
Underflow
Count start conditions
The operation of the watchdog timer after a reset is selected by
the WDTON bit (1) in the OFS register (address 0FFFFh).
When the WDTON bit is set to 1 (watchdog timer is stopped after reset).
The watchdog timer and prescaler are stopped after a reset and
start counting when the WDTS register is written to.
When the WDTON bit is set to 0 (watchdog timer starts automatically after
reset).
The watchdog timer and prescaler start counting automatically after a reset.
Count stop condition
None (Count does not stop even in wait mode and stop mode once it starts.)
Operation at underflow
Watchdog timer reset (Refer to 5.5 Watchdog Timer Reset.)
Registers, bits
When the CSPPRO bit in the CSPR register is set to 1 (count source
protection mode enabled) (2), the following are set automatically:
- The low-speed on-chip oscillator for the watchdog timer is on.
- The PM12 bit in the PM1 register is set to 1 (watchdog timer reset when the
watchdog timer underflows).
相關(guān)PDF資料
PDF描述
R5F213G4DDSP 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO24
R5F213G2DNSP 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO24
R5F213G5DDSP 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO24
R5F213J2CNNP MICROCONTROLLER, QCC36
R5F213J4ANNP 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQCC36
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R5F213G4ANNP 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU
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R5F213G4CDSP 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU
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