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參數(shù)資料
| 型號： | R8820LV |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 16-BIT RISC MICROCONTROLLER |
| 中文描述： | 16位RISC微控制器 |
| 文件頁數(shù)： | 22/98頁 |
| 文件大?。?/td> | 1000K |
| 代理商： | R8820LV |
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R DC
RISC DSP Controller
R8820LV
RDC Semiconductor Co.
Rev:1.0
Subject to change without notice
22
The peripheral control block is mapped into either memory or I/O space by programming this register. When the other chip
selects (PCSx orMCSx ) are programmed to zero wait states and ignore the external ready, thePCSx orMCSx can overlap
the control block.
Bit 15
: Reserved
Bit 14
:
S/
M
, Slave/Master – Configures the interrupt controller
set 0
: Master mode,
set 1:
Slaved mode
Bit 13
: Reserved
Bit 12
:
M/IO
, Memory/IO space. At reset, this bit is set to 0 and the PCB map start at FF00h in I/O space.
set 1
- The peripheral control block (PCB) is located in memory space.
set 0
- The PCB is located in I/O space.
Bit 11-0
:
R19-R8
, Relocation Address Bits
The upper address bits of the PCB base address. The lower eight bits default to 00h. When the PCB is mapped to I/O
space, the R19-R16 must be programmed to 0000b.
Read only register that specifies the processor release version and RDC identify number
Bit 15-8
: Processor version
01h : version A , 02h : version B, 03h : version C, 04h : version D
Bit 7-0
: RDC identify number - D9h
Peripheral Control Block Relocation Register:
Offset : FEh
Reset Value : 20FFh
2
3
0
1
4
5
6
7
8
9
10
11
12
13
14
15
Res
Res
R19 - R8
M/IO
S/M
Processor Release Level Register
Offset : F4h
Reset Value : F9h
3
0
1
2
4
5
6
7
8
9
10
11
12
13
14
15
PRL
1
1
0
1
1
0
0
1
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