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參數(shù)資料
| 型號(hào)： | ARM946E-S |
| 英文描述： | ARM946E-S Microprocessor Core with Cache technical manual 6/01 |
| 中文描述： | ARM946E之，禳微處理器核心與緩存技術(shù)手冊(cè)6月1日 |
| 文件頁(yè)數(shù)： | 97/202頁(yè) |
| 文件大小： | 1395K |
| 代理商： | ARM946E-S |
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D-Cache
Copyright 2000–2001 by LSI Logic Corporation. All rights reserved.
4-9
4.3.2.2 Cd and Bd Bits - Cache Stores
The Bd and Cd bits affect writes that both hit and miss in the D-cache.
If the Bd and Cd bits are both 1, the area of memory is marked as write
back, and stores that hit in the D-cache only update the cache, not
external memory. If the Bd bit is 0 and the Cd bit is 1, the area of
memory is marked as write through, and stores that hit in the D-cache
update both the cache and external memory.
4.3.2.3 Load and Store Multiples
Load and store multiples are divided at 4 Kbyte boundaries (the minimum
protection region size), allowing a protection check to be performed in
case the
Load Multiple
(LDM) or
Store Multiple
(STM) crosses into a
region with different protection properties.
4.3.3 D-Cache Validity
The ARM946E-S does not support memory translation, so you can
always consider the data in the D-cache as valid within the context of the
ARM946E-S. However, if you use external memory translation and the
mappings are changed, the D-cache is no longer consistent with external
memory, and you must flush it.
The ARM946E-S does not support external memory snooping. Any
shared data memory space, therefore, must not be cacheable.
Additionally, if you reprogram the data protection regions, data already in
the cache might now be in a noncacheable region, and you must flush it.
4.3.4 D-Cache Clean and Flush
The D-cache has flexible cleaning and flushing utilities that allow the
following operations:
You can invalidate the whole D-cache (
flush D-cache
) in one
operation without writing back dirty data.
You can invalidate individual lines without writing back any dirty data
(
flush D-cache single entry
).
You can perform cleaning on a line-by-line basis. The data is only
written back through the write buffer when a dirty line is encountered,
and the cleaned line remains in the cache (
clean D-cache single
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PDF描述 |
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| ARM9DIMM-LPC3250 | 功能描述:模塊化系統(tǒng) - SOM LPC3250 ARM9 DIMM Module, Rev 1.0 RoHS:否 制造商:Digi International 外觀尺寸:ConnectCore 9P 處理器類型:ARM926EJ-S 頻率:150 MHz 存儲(chǔ)容量:8 MB, 16 MB 存儲(chǔ)類型:NOR Flash, SDRAM 接口類型:I2C, SPI, UART 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 尺寸:1.97 in x 1.97 in x 6.1 in |
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