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參數(shù)資料
| 型號： | ARM946E-S |
| 英文描述： | ARM946E-S Microprocessor Core with Cache technical manual 6/01 |
| 中文描述： | ARM946E之，禳微處理器核心與緩存技術(shù)手冊6月1日 |
| 文件頁數(shù)： | 116/202頁 |
| 文件大?。?/td> | 1395K |
| 代理商： | ARM946E-S |
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7-2
Bus Interface Unit and Write Buffer
Copyright 2000–2001 by LSI Logic Corporation. All rights reserved.
through the AHB interface for cache line fills and for initializing the tightly
coupled SRAMs. The AHB interface is also used to access code and
data that are not within the cacheable or tightly coupled memory address
regions.
When an AHB access occurs, the BIU and system controller handshake
to ensure that the ARM9E-S processor core is stalled until the access is
finished. If you are using the write buffer, you might be able to allow the
processor core to continue program execution. The BIU controls the write
buffer and related stall behavior.
7.2 AHB Bus Master Interface
The ARM946E-S implements a fully compliant AHB bus master interface
as defined in the
AMBA Specification, Rev 2.0
. See this document for a
detailed description of the AHB protocol.
7.2.1 About the AHB
The AHB architecture is based on separate cycles for address and data
rather than separate clock phases, as in the AMBA Advanced System
Bus (ASB). The address and control for an access are broadcast from
the rising edge of HCLK in the cycle before the data is expected to be
read or written. During this data cycle, the address and control for the
next transfer are driven out, providing a fully pipelined address
architecture.
When an access is in its data cycle, a slave can extend an access by
driving the HREADY signal LOW. This action stretches the current data
cycle, and the pipelined address and control for the next transfer also
stretches. With this system, all AHB masters and slaves sample
HREADY on the rising edge of HCLK to determine when an access is
complete and whether a new address can be sampled or driven out.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| ARM966E-S | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ARM966E-S Microprocessor Core preliminary technical manual 6/01 |
| ARM9DIMM-LPC3250 | 功能描述:模塊化系統(tǒng) - SOM LPC3250 ARM9 DIMM Module, Rev 1.0 RoHS:否 制造商:Digi International 外觀尺寸:ConnectCore 9P 處理器類型:ARM926EJ-S 頻率:150 MHz 存儲容量:8 MB, 16 MB 存儲類型:NOR Flash, SDRAM 接口類型:I2C, SPI, UART 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 尺寸:1.97 in x 1.97 in x 6.1 in |
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