參數(shù)資料
型號: ARM946E-S
英文描述: ARM946E-S Microprocessor Core with Cache technical manual 6/01
中文描述: ARM946E之,禳微處理器核心與緩存技術(shù)手冊6月1日
文件頁數(shù): 158/202頁
文件大?。?/td> 1395K
代理商: ARM946E-S
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁當前第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁
9-20
Debug Interface
Copyright 2000-2001 by LSI Logic Corporation. All rights reserved.
You can program one or both watchpoint units to halt the execution of
instructions by the core. Execution halts when the values programmed
into EmbeddedICE-RT match the values currently appearing on the
address bus, data bus, and various control signals.
Note:
You can mask bits so that their values do not affect the
comparison.
You can configure each watchpoint unit to be either a watchpoint
(monitoring data accesses) or a breakpoint (monitoring instruction
fetches). Watchpoints and breakpoints can be data-dependent in halt
mode debug.
9.4.1 Disabling EmbeddedICE-RT
To disable EmbeddedICE-RT, set the DBGEN input LOW.
Note:
Hardwiring the DBGEN input LOW
permanently
disables
debug access.
When DBGEN is LOW, it inhibits DBGDEWPT, DBGIEBKPT, and
EDBGRQ to the core, and DBGACK from the ARM946E-S is always
LOW.
9.4.2 Debug Communications Channel
The ARM9E-S EmbeddedICE-RT logic contains a communications
channel for passing information between the target and the host
debugger. This channel is implemented as coprocessor 14.
The communications channel consists of:
A 32-bit comms data read register
A 32-bit comms data write register
A 6-bit comms control register for synchronized handshaking
between the processor and the asynchronous debugger
These registers are located in fixed locations in the EmbeddedICE-RT
logic register map and are accessed from the processor using MCR and
MRC instructions to coprocessor 14.
In addition to the comms channel registers, the processor can access a
1-bit debug status register for use in the real-time debug configuration.
相關PDF資料
PDF描述
ARM966E-S ARM966E-S Microprocessor Core preliminary technical manual 6/01
ARS2569 Amplifier. Other
AR2569 Amplifier. Other
ARS4019 Amplifier. Other
AR4019 Amplifier. Other
相關代理商/技術(shù)參數(shù)
參數(shù)描述
ARM966E-S 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ARM966E-S Microprocessor Core preliminary technical manual 6/01
ARM9DIMM-LPC3250 功能描述:模塊化系統(tǒng) - SOM LPC3250 ARM9 DIMM Module, Rev 1.0 RoHS:否 制造商:Digi International 外觀尺寸:ConnectCore 9P 處理器類型:ARM926EJ-S 頻率:150 MHz 存儲容量:8 MB, 16 MB 存儲類型:NOR Flash, SDRAM 接口類型:I2C, SPI, UART 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 尺寸:1.97 in x 1.97 in x 6.1 in