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參數(shù)資料
| 型號： | ARM946E-S |
| 英文描述： | ARM946E-S Microprocessor Core with Cache technical manual 6/01 |
| 中文描述： | ARM946E之，禳微處理器核心與緩存技術(shù)手冊6月1日 |
| 文件頁數(shù)： | 134/202頁 |
| 文件大?。?/td> | 1395K |
| 代理商： | ARM946E-S |
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8-8
External Coprocessor Interface
Copyright 2000–2001 by LSI Logic Corporation. All rights reserved.
committed. In the case of an
MCR
instruction, the CPDOUT[31:0] bus is
driven with the registered data during the coprocessor write stage. In the
case of an
MRC
instruction, CPDIN[31:0] is sampled at the end of the
ARM9E-S processor Memory stage and written to the destination
register during the next cycle.
8.5 Interlocked MCR Instructions
If the data for an
MCR
instruction is not available inside the ARM9E-S
processor pipeline during its first decode cycle, then the ARM9E-S
processor pipeline interlocks for one or more cycles until the data is
available. For example, this interlocking applies when the register being
transferred is the destination from a preceding
LDR
instruction. In this
situation, the
MCR
instruction enters the decode stage of the coprocessor
pipeline, and then remains there a number of cycles before entering the
execute stage.
Figure 8.4
gives an example of an interlocked
MCR
that also has a
busy-wait state.
Figure 8.4
Interlocked MCR Timing with Busy-Wait
Coprocessor
Pipeline
CPLATECANCEL
Fetch
Decode
(Interlock)
Execute
(WAIT)
Execute Memory
(LAST)
Write
CLK
CPINSTR[31:0]
nCPMREQ
CPPASS
CHSDE[1:0]
CHSEX[1:0]
CPDOUT[31:0]
MCR
CPDIN[31:0]
MRC
Ignored
LAST
WAIT
WAIT
Decode
MCR
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ARM966E-S | ARM966E-S Microprocessor Core preliminary technical manual 6/01 |
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參數(shù)描述 |
|---|---|
| ARM966E-S | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ARM966E-S Microprocessor Core preliminary technical manual 6/01 |
| ARM9DIMM-LPC3250 | 功能描述:模塊化系統(tǒng) - SOM LPC3250 ARM9 DIMM Module, Rev 1.0 RoHS:否 制造商:Digi International 外觀尺寸:ConnectCore 9P 處理器類型:ARM926EJ-S 頻率:150 MHz 存儲容量:8 MB, 16 MB 存儲類型:NOR Flash, SDRAM 接口類型:I2C, SPI, UART 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 尺寸:1.97 in x 1.97 in x 6.1 in |
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