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參數(shù)資料
| 型號(hào)： | ARM946E-S |
| 英文描述： | ARM946E-S Microprocessor Core with Cache technical manual 6/01 |
| 中文描述： | ARM946E之，禳微處理器核心與緩存技術(shù)手冊(cè)6月1日 |
| 文件頁數(shù)： | 93/202頁 |
| 文件大?。?/td> | 1395K |
| 代理商： | ARM946E-S |
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I-Cache
Copyright 2000–2001 by LSI Logic Corporation. All rights reserved.
4-5
Note: Data can be marked as dirty only if it resides in a write back
protection region.
4.2 I-Cache
The ARM946E-S has a direct-mapped, 2-way, or 4-way set-associative
I-cache. You can choose the size of the I-cache from any of the
supported cache sizes. The I-cache uses the physical address generated
by the processor core. It uses a policy of
allocate on read-miss
, and is
always reloaded one cache line (eight words) at a time, through the
external interface.
4.2.1 Enabling and Disabling the I-Cache
To enable the I-cache, set bit 12 of the CP15 Control register. The cache
is only enabled if the protection unit is already enabled, or if they are
enabled simultaneously. When the I-cache is enabled, a cacheable read-
miss places lines in the I-cache.
You can enable the I-cache and protection unit simultaneously with a
single write to the CP15 control register, although you must program at
least one protection region before you enable the protection unit.
You can lock critical or frequently accessed instructions into the I-cache.
4.2.2 I-Cache Operation
When enabled, the I-cache operation is also controlled by the Cacheable
instruction (Ci) bit, which is stored in the Protection unit. This bit
selectively enables or disables caching for different memory regions. The
Ci bit affects I-cache operation as follows:
Successful Cache Read –
Data is returned to the core only if the Ci bit
is 1.
Unsuccessful Cache Read –
If the Ci bit is 1, a line fetch of eight
words is performed. The line fetch starts with the requested address
aligned to an eight-word boundary (that is, the line fetch starts with
word 0). If the Ci bit is 0, a single-word external access is performed to
fetch the requested instruction. The cache is not updated.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ARM966E-S | ARM966E-S Microprocessor Core preliminary technical manual 6/01 |
| ARS2569 | Amplifier. Other |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ARM966E-S | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ARM966E-S Microprocessor Core preliminary technical manual 6/01 |
| ARM9DIMM-LPC3250 | 功能描述:模塊化系統(tǒng) - SOM LPC3250 ARM9 DIMM Module, Rev 1.0 RoHS:否 制造商:Digi International 外觀尺寸:ConnectCore 9P 處理器類型:ARM926EJ-S 頻率:150 MHz 存儲(chǔ)容量:8 MB, 16 MB 存儲(chǔ)類型:NOR Flash, SDRAM 接口類型:I2C, SPI, UART 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 尺寸:1.97 in x 1.97 in x 6.1 in |
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