參數(shù)資料
型號： ARM946E-S
英文描述： ARM946E-S Microprocessor Core with Cache technical manual 6/01
中文描述： ARM946E之，禳微處理器核心與緩存技術(shù)手冊6月1日
文件頁數(shù)： 39/202頁
文件大小： 1395K
代理商： ARM946E-S
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Data Cache Signals
Copyright 2000–2001 by LSI Logic Corporation. All rights reserved.
2-17
DCacheSize[3:0]
Data Cache Size
These bits specify the size of the data cache.
Input
DHit[3:0]
Data Cache Hit
Each DHit[3:0] bit corresponds to data cache set [3:0].
When there is a hit on an data cache set, the
corresponding DHit[3:0] bit is driven HIGH.
Output
DIndexDly[12:0]
Data Cache Index Delayed
These bits are a delayed version of the index used to
select valid bits.
Output
DReplIndex
Data Cache Replacement Index
This bit is the index of the line being replaced.
Output
DReplPntr[1:0]
Data Cache Replacement Pointer
These bits point to the data cache set that is affected
when a Cache Maintenance operation uses the index/set
addressing mode.
Output
DSet0EnL, DSet1EnL, DSet2EnL, DSet3EnL
Data Set 0, 1, 2, 3 Lower Enable
Driving this signal HIGH enables the clock on the Set 0,
1, 2, or 3 Lower RAM. Driving it LOW disables the clock,
which saves power. The RAMs do not have to connect to
this pin. The function is not changed if the RAMs ignore
the enable and clock every cycle.
Output
DCacheSize
[3:0]
Encoding
0b0000
0b0011
0b0100
0b0101
0b0110
0b0111
0b1000
0b1001
0b1010
0b1011
0 Kbyte
4 Kbytes
8 Kbytes
16 Kbytes
32 Kbytes
64 Kbytes
128 Kbytes
256 Kbytes
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ARM966E-S 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ARM966E-S Microprocessor Core preliminary technical manual 6/01
ARM9DIMM-LPC3250 功能描述:模塊化系統(tǒng) - SOM LPC3250 ARM9 DIMM Module, Rev 1.0 RoHS:否 制造商:Digi International 外觀尺寸:ConnectCore 9P 處理器類型:ARM926EJ-S 頻率:150 MHz 存儲容量:8 MB, 16 MB 存儲類型:NOR Flash, SDRAM 接口類型:I2C, SPI, UART 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 尺寸:1.97 in x 1.97 in x 6.1 in
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