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參數(shù)資料
| 型號： | ARM946E-S |
| 英文描述： | ARM946E-S Microprocessor Core with Cache technical manual 6/01 |
| 中文描述： | ARM946E之，禳微處理器核心與緩存技術(shù)手冊6月1日 |
| 文件頁數(shù)： | 94/202頁 |
| 文件大?。?/td> | 1395K |
| 代理商： | ARM946E-S |
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4-6
Caches
Copyright 2000–2001 by LSI Logic Corporation. All rights reserved.
Clearing bit 12 of the CP15 Control register disables the I-cache. This
action prevents all I-cache look ups and line fills, and forces all instruction
fetches to be performed as single external accesses.
4.2.3 I-Cache Validity
The ARM946E-S does not support external memory snooping.
Therefore, if you write self-modifying code, the instructions in the I-cache
can become incoherent with external memory. Similarly, if you reprogram
the protection regions, code might exist in the cache that should be in a
noncacheable region. In either of these cases, you must flush the
I-cache.
4.2.4 I-Cache Flush
You can flush the entire I-cache by software in one operation, or you can
flush individual cache lines by writing to the CP15 Cache Operations
register (register 7). The I-cache is automatically flushed during reset.
The I-cache never has to be cleaned because its only source of data is
from external memory. (The ARM9E-S processor only performs reads
from the I-cache, except during debug operations.)
Flushing the Entire Cache –
As shown in
Table 3.4
on
page 3-22
, you
can flush the entire I-cache using an MCR instruction. In this case, the
contents of the ARM register transferred to CP15 must be 0. You can use
the following code to do this:
MOV
MCR
r0, #0
p15, r0, c7, c5, 0; Flush entire instruction cache
; Clear r0
Note:
The use of r0 is arbitrary.
Flushing the entire cache also flushes any locked-down code. If you want
to preserve locked-down code, you must flush cache lines individually
and avoid the locked-down lines.
Flushing a Single Cache Line –
You can flush single cache lines. To
do this, you must specify in Rd the address to be flushed from the cache.
You can use the following code to do this:
LDR r0, = FlushAddress; Load r0 with address
FlushAddress
MCR p15, r0, c7, c5, 1; Flush single cache line
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ARM966E-S | ARM966E-S Microprocessor Core preliminary technical manual 6/01 |
| ARS2569 | Amplifier. Other |
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| ARS4019 | Amplifier. Other |
| AR4019 | Amplifier. Other |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ARM966E-S | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ARM966E-S Microprocessor Core preliminary technical manual 6/01 |
| ARM9DIMM-LPC3250 | 功能描述:模塊化系統(tǒng) - SOM LPC3250 ARM9 DIMM Module, Rev 1.0 RoHS:否 制造商:Digi International 外觀尺寸:ConnectCore 9P 處理器類型:ARM926EJ-S 頻率:150 MHz 存儲容量:8 MB, 16 MB 存儲類型:NOR Flash, SDRAM 接口類型:I2C, SPI, UART 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 尺寸:1.97 in x 1.97 in x 6.1 in |
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