參數(shù)資料
型號(hào)： 82443ZX
廠商： INTEL CORP
元件分類： 存儲(chǔ)控制器/管理單元
英文描述： Intel㈢ 440ZX AGPset: Host Bridge/Controller
中文描述： DRAM CONTROLLER, PBGA492
封裝： BGA-492
文件頁(yè)數(shù)： 72/116頁(yè)
文件大?。?/td> 533K
代理商： 82443ZX
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Register Description
3-48
82443ZX Host Bridge Datasheet
3.4.4
PCISTS1—PCI-to-PCI Status Register (Device 1)
Address Offset:
Default Value:
Access:
Size:
06–07h
0220h
Read Only, Read/Write Clear
16 bits
PCISTS1 is a 16-bit status register that reports the occurrence of error conditions associated with
primary side of the “virtual” PCI-to-PCI bridge embedded within the 82443ZX.
3.4.5
RID1—Revision Identification Register (Device 1)
Address Offset:
Default Value:
Access:
Size:
08h
00/01h
Read Only
8 bits
This register contains the revision number of the 82443ZX device #1. These bits are read only and
writes to this register have no effect. For the A-0 Stepping, this value is 00h.
Bit
Descriptions
15
Detected Parity Error (DPE1).
Not Applicable. Hardwired to 0.
14
Reserved.
13
Received Master Abort Status (RMAS1).
Not Applicable. Hardwired to 0.
12
Received Target Abort Status (RTAS1).
Not Applicable. Hardwired to 0.
11
Signaled Target Abort Status (STAS1).
Not Applicable. Hardwired to 0.
10:9
DEVSEL# Timing (DEVT1).
Not Applicable. Hardwired to “01b”.
8
Data Parity Detected (DPD1).
Not Applicable. Hardwired to 0.
7
Fast Back-to-Back (FB2B1).
Not Applicable. Hardwired to 0.
6
Reserved.
5
66/60 MHz Capability.
Hardwired to “1”.
4:0
Reserved.
Bit
Description
7:0
Revision Identification Number.
This is an 8-bit value that indicates the revision identification
number for the 82443ZX device #1.
02h = B1 stepping
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