參數(shù)資料
型號： 82443ZX
廠商： INTEL CORP
元件分類： 存儲控制器/管理單元
英文描述： Intel㈢ 440ZX AGPset: Host Bridge/Controller
中文描述： DRAM CONTROLLER, PBGA492
封裝： BGA-492
文件頁數(shù)： 53/116頁
文件大小： 533K
代理商： 82443ZX
82443ZX Host Bridge Datasheet
3-29
Register Description
3.3.23
RPS—SDRAM Row Page Size Register (Device 0)
Address Offset:
Default Value:
Access:
Size:
74h–75h
0000h
Read/Write
16 bits
This register sets the row page size for SDRAM only. For EDO memory, the page size is fixed at
2 KB.
3.3.24
SDRAMC—SDRAM Control Register (Device 0)
Address Offset:
Default Value:
Access:
Size:
76h–77h
00h
Read/Write
16 bits
Bit
Description
15:0
Page Size (PS).
Each pair of bits in this register indicate the page size used for one row of DRAM.
The encoding of the two bit fields.
Bits[1:0]
Page Size
00
2 KB
01
4 KB
10
8 KB
11
Reserved
RPS bits
Corresponding DRB register
1:0
DRB[0], row 0
3:2
DRB[1], row 1
5:4
DRB[2], row 2
7:6
DRB[3], row 3
9:15
Not Applicable in the 82443ZX.
Bit
Description
15:10
Reserved
9:8
Idle/Pipeline DRAM Leadoff Timing (IPDLT).
Adds a clock delay to the lead-off clock count
when bits 9:8 are set to 01. All other settings are illegal.
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82444 877U500 功能描述:多芯電纜 22AWG 4C UNSHLD 500ft BOX NATURAL RoHS:否 制造商:Alpha Wire 導(dǎo)體數(shù)量:3 線規(guī) - 美國線規(guī)（AWG）:16 絞合:19 x 29 屏蔽:Shielded 長度:100 ft 電壓額定值:600 V 外殼材料:Polytetrafluoroethylene (PTFE) 絕緣材料:Polytetrafluoroethylene (PTFE) 類型:Communication and Control
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