參數(shù)資料
型號(hào): MC68328PV
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: MICROCONTROLLER, PQFP144
封裝: PLASTIC, TQFP-144
文件頁數(shù): 80/198頁
文件大小: 551K
代理商: MC68328PV
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Applications and Design Examples
16-2
MC68328 USER’S MANUAL 11/10/97
MOTOROLA
APPLICATIONS
AND
14
DESIGN
EXAMPLES
PRELIMINARY
16.1.1 M68328 Processor Signal Configuration
A low boot bus width-select (BBUSW) at reset means that the system will boot up with an 8-
bit ROM. A low mode-clock (MOCLK) signal at reset means that the M68328 processor uses
the 32.768kHz crystal and enables its internal PLL to supply the clock for the entire chip.
The suggested circuit for PLL is shown in Figure 14-2. The RESET signal should be
connected to the JTAGRST signal to ensure that the entire chip (including the JTAG block)
is reset properly at the same time. The RESET and JTAGRST should be held low for more
than 100ms before they are released as required by the M68EC000 user’s manual. There
is no power-on-reset circuit implemented in the M68328 processor; therefore, use external
circuits (either from a MC1455 mono-stable timer or power-on-reset signal from most of the
power supply chips) to generate the RESET signal. The RESET signal in this example
connects to a debouncing circuit to generate a reset for the M68328 processor.
Figure 16-2. M68328 Processor Signal Configuration
To Power Supply
PLLVCC
RESET
MC68328
XTAL
EXTAL
16.67MHZ
32.768kHz
20pF
PLLGND
VCC’s
GND’s
To Power Supply
IRQ7
10K
VCC
JTAGRST
TDI
TDO
TMS
TCK
10K
VCC
10K
VCC
10K
VCC
BBUSW
MOCLK
RESET
ABORT
.luf
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PDF描述
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