參數(shù)資料
型號(hào): MC68328PV
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: MICROCONTROLLER, PQFP144
封裝: PLASTIC, TQFP-144
文件頁數(shù): 40/198頁
文件大?。?/td> 551K
代理商: MC68328PV
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Universal Asynchronous Receiver/Transmitter
MOTOROLA
MC68328 USER’S MANUAL 12/9/97
11-7
UART
11
PRELIMINARY
11.3.4 MPU Interface
The MPU interface includes all status and control registers and all miscellaneous logic. This
block directly connects to the internal 68000 bus and provides address decode for three
address lines and a full 16-bit read/write port. The interrupt line is the logical-OR of the eight
interrupt sources. When the UART EN bit is low, the master clock to all UART blocks is
disabled, thus keeping power consumption to a minimum.
11.4 PROGRAMMING MODEL
11.4.1 UART Status and Control Register
The UART status and control (USTCNT) register controls overall UART operation.
UART EN—UART Enable
This bit enables the UART. When this bit is low, the UART is disabled to save power. When
it is high, the UART is active. This bit resets to 0.
0 = UART disabled.
1 = UART enabled.
RX EN—Receiver Enable
This bit enables the receiver block. When this bit is low, the receiver is disabled and the
receive FIFO is flushed. This bit resets to 0.
0 = Receiver disabled and receive FIFO flushed.
1 = Receiver enabled.
USTCNT
BIT
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
FIELD
UART
EN
RX EN
TX EN
CLK
MODE
PARITY
EN
ODD
EVEN
STOP
8/7
GPIO
DELTA
EN
CTS
DELTA
EN
RX
FULL
EN
RX
HALF
EN
RXRDY
EN
TX
EMPTY
EN
TX
HALF
EN
TX
AVAIL
EN
R/W
R/W
RESET
0x0000
ADDR
0x(FF)FFF900
Note: When the UART is first enabled after a cold reset (before enabling interrupts) set
the UARTEN and RXEN bits and perform a word-read operation on the UART
receiver register to initialize the FIFO and character status bits.
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PDF描述
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