參數(shù)資料
型號: MC68328PV
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: MICROCONTROLLER, PQFP144
封裝: PLASTIC, TQFP-144
文件頁數(shù): 26/198頁
文件大?。?/td> 551K
代理商: MC68328PV
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Timers
10-4
MC68328 USER’S MANUAL 12/9/97
MOTOROLA
TIMERS
10
PRELIMINARY
10.5 PROGRAMMING THE GENERAL-PURPOSE TIMERS
10.5.1 Timer Unit 1 and 2 Control Registers
You can use the timer unit 1 and 2 control registers (TCTL1 and TCTL2) to configure the
overall operation of the timers.
FRR—Free Run/Restart
This bit controls the timer operation when a “reference” event occurs. In the free-run mode,
the timer counter continues normal counting from its current value. In the restart mode, the
counter is reset to 0, then resumes counting.
0 = Restart mode (reset counter to 0 and resume counting).
1 = Free-run mode (continue to run).
CAPTURE EDGE
This field control the operation of the capture function.
00 = Disable interrupt on capture event.
01 = Capture on rising edge of TINx and generate interrupt on capture.
10 = Capture on falling edge of TINx and generate interrupt on capture.
11 = Capture on rising or falling edges of TINx and generate interrupt on capture.
OM—Output Mode
This bit controls the output mode of the timer after a reference compare event.
0 = Active-low pulse for one SYSCLK period.
1 = Toggle output.
IRQEN—Reference Event Interrupt Enable
This bit enables the timer interrupt when a reference event occurs. These maskable timer
interrupts are a level 6 interrupt for timer 1 or a level 4 interrupt for timer 2.
0 = Disable interrupt on reference event.
1 = Enable interrupt on reference event.
TCTL1 AND TCTL2
BIT
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
FIELD
FRR
CAPTURE EDGE
OM
IRQEN
CLKSOURCE
TEN
R/W
R/W
RESET
0x0000
ADDR
0x(FF)FFF600 (TIMER 1) AND 0x(FF)FFF60C (TIMER 2)
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PDF描述
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