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參數(shù)資料
| 型號： | MC68328PV |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER, PQFP144 |
| 封裝： | PLASTIC, TQFP-144 |
| 文件頁數(shù)： | 181/198頁 |
| 文件大?。?/td> | 551K |
| 代理商： | MC68328PV |
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LCD Controller
8-2
MC68328 USER’S MANUAL 12/9/97
MOTOROLA
LCD
CONTROLLER
8
PRELIMINARY
8.1.1 MPU Interface
The MPU interface consists of control registers that enable you to operate different features
of the LCD controller. This block is connected directly to the MC68EC000 core internal bus.
8.1.2 Screen DMA Controller
The screen DMA controller periodically generates a bus request (BR) signal to the
MC68EC000 core and when it receives a bus grant (BG) signal, it performs a 16- or 8-word
memory burst to fill the line buffer. You can program the number of DMA clock cycles (1 to
16) per transfer to support systems with varieable memory speed requirements. When the
DMA transfer begins, one clock cycle is added to the first data word has one clock cycle
added to the transfer and the number of clock cycles selected. As shown in Figure 8-2 and
Figure 8-3, this gives the initial chip-select memory more time without generating a clock
cycle penalty on subsequent data transfers of the line fill.
Figure 8-1. LCD Controller Block Diagram
SCREEN
DMA
LINE BUFFER
FRAME
RATE
CONTROL
PIXCLK
DMA
SYSTEM
68EC000
LCD DRIVER
LCD
DRIVER
CLOCK
ADDRESS
DATA
LCD
INTERFACE
(FAST)
(SLOW)
LCDC
CURSOR
LOGIC
CORE
CS
MEMORY
MPU
INTERFACE
REGISTERS
BR
BG
SIM28
OE
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PDF描述 |
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參數(shù)描述 |
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