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參數(shù)資料
| 型號(hào)： | L64381 |
| 廠商： | LSI Corporation |
| 英文描述： | 4-Port Ethernet Controller(四端口以太網(wǎng)控制器) |
| 中文描述： | 4端口以太網(wǎng)控制器（四端口以太網(wǎng)控制器） |
| 文件頁數(shù)： | 98/109頁 |
| 文件大?。?/td> | 815K |
| 代理商： | L64381 |
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7-12
Specifications
7.3
Special VDD
and VSS
Connections
To minimize EMI and digital noise coupling, the L64381 provides sepa-
rate power and ground for each port. The output buffers driving the
DATAP[3:0], DATAN[3:0], PREEP[3:0], and PREEN[3:0] pins of each port
have their own VDD and VSS pins, and are thus decoupled from the
VDD and VSS pins for the remaining chip output buffers. Table 7.7 lists
the VDD and VSS pins for each port.
Table 7.7
VDD/VSS Pin
Numbers Per Port
PREADY
PREEN[3:0]
PREEP[3:0]
P_TESTN
RCVNGN
READ
READ_OUT_PKT Read Data from Receive FIFO
RESET
Reset
SOP
Start of Packet
STROBE
Strobe
TCK
JTAG Test Clock
TDI
JTAG Test Data In
TDO
JTAG Test Data Out
TMS
JTAG Test Mode Select
TP/AUI[3:0]
Twisted-Pair/AUI Select
TRNSMTN
Transmitter Status
TRSTN
JTAG Test Reset
WRITE_IN_PKT
Write Data to Transmit FIFO
(Sheet 2 of 2)
Ready
Negative Pre-emphasis
Positive Pre-emphasis
Global 3-State
Receiver Status
Read
Output
Output
Output
CMOS Input, PU
Output
Input
Input
Input
Bidirectional
Input
Input
Input, PU
Output
Input, PU
Input
Output
Input, PU
Input
4
24
24
–
4
–
–
–
4
–
–
–
4
–
–
4
–
–
Low
–
–
Low
Low
Low
Low
Low
Low
Low
–
–
–
–
–
Low
Low
Low
Table 7.6 (Cont.)
Pin Description
Summary
Mnemonic
Description
Type
Drive
(mA)
Active
Port Number
VDD Pin Number
VSS Pin Number
0
1
2
3
139
120
107
101
140
119
108
102
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| L64388 | A General-Purpose,High-Performance Remote Access Communications Processor(通用的、高性能、遠(yuǎn)程訪問通信處理器) |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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